参数资料
型号: ADSP-21368KBPZ-2A
厂商: Analog Devices Inc
文件页数: 36/64页
文件大小: 0K
描述: IC DSP 32BIT 333MHZ 256-BGA
产品培训模块: SHARC Processor Overview
标准包装: 1
系列: SHARC®
类型: 浮点
接口: DAI,DPI
时钟速率: 333MHz
非易失内存: ROM(768 kB)
芯片上RAM: 256kB
电压 - 输入/输出: 3.30V
电压 - 核心: 1.20V
工作温度: 0°C ~ 70°C
安装类型: 表面贴装
封装/外壳: 256-LBGA 裸露焊盘
供应商设备封装: 256-BGA(27x27)
包装: 托盘
Rev. F
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October 2013
Pulse-Width Modulation Generators
Sample Rate Converter—Serial Input Port
The SRC input signals SCLK, frame sync (FS), and SDATA are
routed from the DAI_P20–1 pins using the SRU. Therefore, the
timing specifications provided in Table 35 are valid at the
DAI_P20–1 pins.
Table 34. PWM Timing
Parameter
Min
Max
Unit
Switching Characteristics
t
PWMW
PWM Output Pulse Width
t
PCLK – 2
(216 – 2) × t
PCLK
ns
t
PWMP
PWM Output Period
2 × t
PCLK – 1.5
(216 – 1) × t
PCLK
ns
Figure 28. PWM Timing
PWM
OUTPUTS
tPWMW
tPWMP
Table 35. SRC, Serial Input Port
Parameter
Min
Max
Unit
Timing Requirements
t
SRCSFS
1
FS Setup Before SCLK Rising Edge
4
ns
t
SRCHFS
1
FS Hold After SCLK Rising Edge
5.5
ns
t
SRCSD
1
SDATA Setup Before SCLK Rising Edge
4
ns
t
SRCHD
1
SDATA Hold After SCLK Rising Edge
5.5
ns
t
SRCCLKW
Clock Width
(t
PCLK × 4) ÷ 2 – 1
ns
t
SRCCLK
Clock Period
t
PCLK × 4
ns
1 DATA, SCLK, FS can come from any of the DAI pins. SCLK and FS can also come via PCG or SPORTs. PCG’s input can be either CLKIN or any of the DAI pins.
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