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参数资料
| 型号： | ADUC7036BCPZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 26/132页 |
| 文件大小： | 0K |
| 描述： | IC MCU FLASH 96K ANLGI/O 48LFCSP |
| 产品培训模块： | Process Control |
| 标准包装： | 1 |
| 系列： | MicroConverter® ADuC7xxx |
| 核心处理器： | ARM7 |
| 芯体尺寸： | 16/32-位 |
| 速度： | 20.48MHz |
| 连通性： | LIN，SPI，UART/USART |
| 外围设备： | PSM，温度传感器，WDT |
| 输入/输出数： | 9 |
| 程序存储器容量： | 96KB（48K x 16） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 1.5K x 32 |
| 电压 - 电源 (Vcc/Vdd)： | 3.5 V ~ 18 V |
| 数据转换器： | A/D 2x16b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 115°C |
| 封装/外壳： | 48-VFQFN 裸露焊盘，CSP |
| 包装： | 托盘 |
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ADuC7036
Rev. C | Page 121 of 132
LIN Frame Data Transmission and Reception
To manage data on the LIN bus requires use of the following
UART MMRs:
When the break symbol and synchronization byte have been
correctly received, data is transmitted and received via the COMTX
and COMRX MMRs, after UART is configured to the required
baud rate. To configure the UART for use with LIN requires the
use of the following UART MMRs:
COMTX: 8-bit transmit register
COMRX: 8-bit receive register
COMCON0: line control register
COMSTA0: line status register
COMDIV0: divisor latch (low byte).
In addition, transmitting data on the LIN bus requires that the
relevant data be placed into COMTX, and reading data received
on the LIN bus requires the monitoring of COMRX. To ensure
that data is received or transmitted correctly, COMSTA0 should
be monitored. For more information, see the UART Serial
Interface and UART Register Definitions sections.
COMDIV1: divisor latch (high byte).
COMDIV2: 16-bit fractional baud divide register. The
required values for COMDIV0, COMDIV1, and COMDIV2
are derived from the LHSVAL0, to generate the required
baud rate.
COMCON0: line control register. As soon as the UART is
correctly configured, the LIN protocol for receiving and
transmitting data is identical to the UART specification.
Under software control, it is possible to multiplex the UART data
lines (TxD and RxD) to the external GPIO_7/IRQ4 and
GPIO_8/IRQ5 pins. For more information, see the GPIO Port1
Control Register (GP1CON) section.
13
tBIT
2
tBIT
2
tBIT
2
tBIT
2
tBIT
>1
tBIT
> = 14
tBIT
8
tBIT
BREAK
SYNC
STA S0
S1
S2
S3
S4
S5
S6
S7 STO
PROTECTED ID
07
474
-04
4
Figure 47. LIN Interface Timing
tBREAK > 13tBIT
BREAK
DELIMIT
START
BIT
07
47
4-
04
5
Figure 48. LIN Break Field
tBIT
STOP
BIT
START
BIT
07
47
4-
04
6
Figure 49. LIN Sync Byte Field
ID1
ID0
START
BIT
STOP
BIT
tBIT
ID2
ID3
ID4
ID5
P0
P1
07
47
4-
04
7
Figure 50. LIN Identifier Byte Field
BIT1
BIT0
START
BIT
STOP
BIT
tBIT
BIT2
BIT3
BIT4
BIT5
BIT6
BIT7
07
47
4-
04
8
Figure 51. LIN Data Byte Field
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