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参数资料
| 型号： | AGLN250V2-CS81 |
| 元件分类： | FPGA |
| 英文描述： | FPGA, 6144 CLBS, 250000 GATES, 250 MHz, PBGA81 |
| 封装： | 5 X 5 MM, 0.8 MM HEIGHT, 0.5 MM PITCH, CSP-81 |
| 文件页数： | 77/140页 |
| 文件大小： | 4325K |
| 代理商： | AGLN250V2-CS81 |
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IGLOO nano Low Power Flash FPGAs
Re vi s i on 10
2 - 27
Timing Characteristics
Applies to 1.5 V DC Core Voltage
Table 2-36 3.3 V LVTTL / 3.3 V LVCMOS Low Slew – Applies to 1.5 V DC Core Voltage
Commercial-Case Conditions: TJ = 70°C, Worst-Case VCC = 1.425 V, Worst-Case VCCI = 3.0 V
Drive Strength
Speed Grade
tDOUT
tDP
tDIN
tPY
tPYS
tEOUT
tZL
tZH
tLZ
tHZ
Units
2 mA
STD
0.97
3.52
0.19
0.86
1.16
0.66
3.59
3.42
1.75
1.90
ns
4 mA
STD
0.97
3.52
0.19
0.86
1.16
0.66
3.59
3.42
1.75
1.90
ns
6 mA
STD
0.97
2.90
0.19
0.86
1.16
0.66
2.96
2.83
1.98
2.29
ns
8 mA
STD
0.97
2.90
0.19
0.86
1.16
0.66
2.96
2.83
1.98
2.29
ns
Note:
For specific junction temperature and voltage supply levels, refer to Table 2-6 on page 2-6 for derating values.
Table 2-37 3.3 V LVTTL / 3.3 V LVCMOS High Slew – Applies to 1.5 V DC Core Voltage
Commercial-Case Conditions: TJ = 70°C, Worst-Case VCC = 1.425 V, Worst-Case VCCI = 3.0 V
Drive Strength
Speed Grade
tDOUT
tDP
tDIN
tPY
tPYS
tEOUT
tZL
tZH
tLZ
tHZ
Units
2 mA
STD
0.97
2.16
0.19
0.86
1.16
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2.20
1.80
1.75
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ns
4 mA
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2.20
1.80
1.75
1.99
ns
6 mA
STD
0.97
1.79
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1.98
2.38
ns
8 mA
STD
0.97
1.79
0.19
0.86
1.16
0.66
1.83
1.45
1.98
2.38
ns
Notes:
1. Software default selection highlighted in gray.
2. For specific junction temperature and voltage supply levels, refer to Table 2-6 on page 2-6 for derating values.
相关PDF资料 |
PDF描述 |
|---|---|
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相关代理商/技术参数 |
参数描述 |
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