参数资料
| 型号： | AS3658F-BCTP |
| 厂商： | ams |
| 文件页数： | 93/158页 |
| 文件大小： | 0K |
| 描述： | IC PMU POWER/AUDIO 124-CTBGA |
| 标准包装： | 2,500 |
| 应用： | 便携式设备 |
| 电流 - 电源： | 7mA |
| 电源电压： | 3 V ~ 5.5 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 124-TFBGA |
| 供应商设备封装： | 124-CTBGA（8x8） |
| 包装： | 带卷 (TR) |
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AS3658
Data Sheet Confidential
- Detailed Description- Audio Functions
Figure 41. I2S Control Diagram
i2s_s elect
mc lk_invert
0
i2s_mc lk_en
1
i2s_master_on
i2s_s elect
i2s_lrck_sclk_out_en
SDI
SDO1
0
1
sc lk _invert
SCLK
LRCLK
Equalizer
18 Bit DAC
mono to stereo
conversion f or
pc m_mode=1
A udio left
A udio right
SDI1
0
MCLK
SDO
ext_mclk
SCLK1
LRCLK1
0
1
i2s _select
i2s_s elect
i2s_master_on
0
1
mc lk 256
pll_mode
PLL
rising edge only
for PCM
com patibility
LRCLK_out
* 256
* 64
1
0
1
I2S_mclk_en
SDO
SCLK
LRCLK
14 Bit ADC
A udio lef t
A udio right
MCLK1
0
1
*2
0
1
mclk_invert
MCLK
S ample rate
Fadc2 pcm_mode samle_rate
0 0 LRCLK / 2
SDI2
SCLK2
i2s _master_on
sc lk_invert
1 0 LRCLK / 4
0 1 LRCLK
i2s_lrck_s clk _out_en
LRCLK2
i2s _master_on
s do3_select
MCLK2
MCLK divider
i2s_lrck_sclk_out_en
i2s_master_on
0
i2s_mc lk_out_en
1
SDO3
SCLK3
i2s _clk_divider<11:0>
sdo_on_mclk1_en
0
1
mclk_invert
i2s_3_on
LRCLK3
SPDIF
SPDIF
spdif _ctrl<1:0>
Figure 42. I2S Timing Diagram
MCLK
64 cycles
64 cycles
LRCK
SCLK
Left Channel
Right Channel
SDATA
16 bit
15
2
1
0
15
2
1
0
SDATA
18 bit
17
2
1
0
17
2
1
0
Table 91. PLL,MCLK Settings
I2S_mclk_en
0
0
0
0
I2S_select
0
0
1
1
mclk_invert
0
1
0
1
Description
I2S_1 selected (PLL used)
Internal MCLK synchronized to external LRCLK
I2S_1 selected (PLL used)
Internal LRCLK used, synchronized to external SDI
I2S_2 selected (PLL used)
Internal MCLK synchronized to external LRCLK
I2S_2 selected (PLL used)
Internal LRCLK used, synchronized to external SDI
www.austriamicrosystems.com
Revision 1v13
92 - 157
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PDF描述 |
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参数描述 |
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