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参数资料
| 型号： | C8051F300-TB |
| 厂商： | Silicon Laboratories Inc |
| 文件页数： | 98/178页 |
| 文件大小： | 0K |
| 描述： | BOARD PROTOTYPING W/C8051F300 |
| 标准包装： | 1 |
| 类型： | MCU |
| 适用于相关产品： | C8051F300 |
| 所含物品： | 板 |
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C8051F300/1/2/3/4/5
26
Rev. 2.9
IDD Supply Sensitivity (Note 3) F = 25 MHz
—
47
—
%/V
F = 1 MHz
—
59
—
%/V
IDD Frequency Sensitivity
(Note 3, Note 5)
VDD = 3.0 V, F <= 1 MHz, T = 25 °C
—
0.27
—
mA/MHz
VDD = 3.0 V, F > 1 MHz, T = 25 °C
—
0.10
—
mA/MHz
VDD = 3.6 V, F <= 1 MHz, T = 25 °C
—
0.35
—
mA/MHz
VDD = 3.6 V, F > 1 MHz, T = 25 °C
—
0.12
—
mA/MHz
Digital Supply Current
(Stop Mode, shutdown)
Oscillator not running,
VDD Monitor Disabled
—< 0.1—
A
Notes:
1. Given in Table 9.2 on page 86.
2. SYSCLK must be at least 32 kHz to enable debugging.
3. Based on device characterization data; Not production tested.
4. Normal IDD can be estimated for frequencies <= 15 MHz by simply multiplying the frequency of interest by
the frequency sensitivity number for that range. When using these numbers to estimate IDD for >15 MHz, the
estimate should be the current at 25 MHz minus the difference in current indicated by the frequency sensitivity
number.
For example: VDD = 3.0 V; F = 20 MHz, IDD = 6.6 mA – (25 MHz – 20 MHz) x 0.16 mA/MHz = 5.8 mA.
5. Idle IDD can be estimated for frequencies <= 1 MHz by simply multiplying the frequency of interest by the
frequency sensitivity number for that range. When using these numbers to estimate Idle IDD for >1 MHz, the
estimate should be the current at 25 MHz minus the difference in current indicated by the frequency sensitivity
number.
For example: VDD = 3.0 V; F = 5 MHz, Idle IDD = 3.3 mA – (25 MHz – 5 MHz) x 0.10 mA/MHz = 1.3 mA.
Table 3.1. Global Electrical Characteristics (Continued)
–40 to +85 °C, 25 MHz system clock unless otherwise specified.
Parameter
Conditions
Min
Typ
Max
Units
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
|---|---|
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