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参数资料
| 型号： | CDK5581 |
| 厂商： | Cirrus Logic Inc |
| 文件页数： | 9/32页 |
| 文件大小： | 0K |
| 描述： | KIT BOARD FOR CDB5581 ADC |
| 标准包装： | 1 |
| 系列： | CapturePLUS™II |
| ADC 的数量： | 1 |
| 位数： | 16 |
| 采样率（每秒）： | 200k |
| 数据接口： | 串行 |
| 输入范围： | ±2.048 V |
| 在以下条件下的电源（标准）： | 85mW @ 200kSPS |
| 工作温度： | -40°C ~ 85°C |
| 已用 IC / 零件： | CS5581 |
| 已供物品： | 2 个板，线缆，CD，电源 |
| 产品目录页面： | 756 (CN2011-ZH PDF) |
| 相关产品： | 598-1272-5-ND - IC ADC 16BIT 1CH 200KSPS 24SSOP |
| 其它名称： | 598-1574 |
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3/25/08
14:34
SWITCHING CHARACTERISTICS (CONTINUED)
T A = -40 to +85 °C; V1+ = V2+ = +2.5 V, ±5%; V1- = V2- = -2.5 V, ±5%;
VL - VLR = 3.3 V, ±5%, 2.5 V, ±5%, or 1.8 V, ±5%
Input levels: Logic 0 = 0V = Low; Logic 1 = VD+ = High; CL = 15 pF.
CS5581
Parameter
Symbol
Min
Typ
Max
Unit
Serial Port Timing in SEC Mode (SMODE = VLR)
SCLK(in) Pulse Width (High)
SCLK(in) Pulse Width (Low)
CS hold time (high) after RDY falling
CS hold time (high) after SCLK rising
-
-
t 15
t 16
30
30
10
10
-
-
-
-
-
-
-
-
ns
ns
ns
ns
CS low to SDO out of Hi-Z
Data hold time after SCLK rising
Data setup time before SCLK rising
t 17
t 18
t 19
-
-
10
10
10
-
-
-
-
ns
ns
ns
CS hold time (low) after SCLK rising
RDY rising after SCLK falling
t 20
t 21
10
-
-
10
1
SCLK
-
10
ns
ns
15.
SDO will be high impedance when CS is high. In some systems SDO may require a pull-down resistor.
MCLK
t 21
RDY
CS
SCLK(i)
t 17
t 15
t 16
t 18 t 19
t 20
SDO
MSB
LSB
Figure 3. SEC Mode - Continuous SCLK Read Timing (Not to Scale)
DS796PP1
9
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