- 您现在的位置：买卖IC网 > Datasheet目录411 > EM260-BBRD-128K-USART-R (Silicon Laboratories Inc)EM260 BREAKOUT BOARD Datasheet资料下载
参数资料
| 型号： | EM260-BBRD-128K-USART-R |
| 厂商： | Silicon Laboratories Inc |
| 文件页数： | 22/50页 |
| 文件大小： | 0K |
| 描述： | EM260 BREAKOUT BOARD |
| 标准包装： | 12 |
| 类型： | 收发器，802.15.4/Zigbee |
| 频率： | 2.4GHz |
| 适用于相关产品： | EM260 |
| 其它名称： | 636-1026 |
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EM260
5 SPI Protocol
The EM260 Low Level Protocol centers on the SPI interface for communication with a pair of GPIO for
handshake signaling.
The EM260 looks like a hardware peripheral.
The EM260 is the slave device and all transactions are initiated by the Host (the master).
The EM260 supports a reasonably high data rate.
5.1
Physical Interface Configuration
The EM260 supports both SPI Slave Mode 0 (clock is idle low, sample on rising edge) and SPI Slave Mode 3
(clock is idle high, sample on rising edge) at a maximum SPI clock rate of 5MHz, as illustrated in Figure 4. The
convention for the waveforms in this document is to show Mode 0.
Clock, Mode 0 (SCLK)
Clock, Mode 3 (SCLK)
Host – Master (MOSI)
EM260 – Slave (MISO)
MSB
MSB
LSB
LSB
Figure 4. SPI Transfer Format, Mode 0 and Mode 3
The nHOST_INT signal and the nWAKE signal are both active low. The Host must supply a pull-up resistor on
the nHOST_INT signal to prevent errant interruptions during undefined events such as the EM260 resetting.
The EM260 supplies an internal pull-up on the nWAKE signal to prevent errant interruptions during undefined
events such as the Host resetting.
5.2
SPI Transaction
The basic EM260 SPI transaction is half-duplex to ensure proper framing and to give the EM260 adequate
response time. The basic transaction, as shown in Figure 5, is composed of three sections: Command, Wait,
and Response. The transaction can be considered analogous to a function call. The Command section is the
function call, and the Response section is the return value.
nHOST_INT
nSSEL
MOSI
MISO
SCLK
Command
Wait
Response
Figure 5. General Timing Diagram for a SPI Transaction
120-0260-000M Rev 1.1
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