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参数资料
| 型号： | EP20K100 |
| 厂商： | Altera Corporation |
| 英文描述： | Programmable Logic Device Family |
| 中文描述： | 可编程逻辑器件系列 |
| 文件页数： | 42/117页 |
| 文件大小： | 570K |
| 代理商： | EP20K100 |
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42
Altera Corporation
APEX 20K Programmable Logic Device Family Data Sheet
Each IOE drives a row, column, MegaLAB, or local interconnect when
used as an input or bidirectional pin. A row IOE can drive a local,
MegaLAB, row, and column interconnect; a column IOE can drive the
column interconnect.
Figure 27
shows how a row IOE connects to the
interconnect.
Figure 27. Row IOE Connection to the Interconnect
Row In
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相关PDF资料 |
PDF描述 |
|---|---|
| EP20K1000E | Programmable Logic Device Family |
| EP20K100E | Programmable Logic Device Family |
| EP20K1500E | Programmable Logic Device Family |
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| EP20K200 | Programmable Logic Device Family |
相关代理商/技术参数 |
参数描述 |
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| EP20K1000CB652C9 | 功能描述:FPGA - 现场可编程门阵列 CPLD - APEX 20K 2560 Macro 488 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256 |
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