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参数资料
| 型号： | EP20K600EFC1020-1ES |
| 英文描述： | FPGA |
| 中文描述： | FPGA的 |
| 文件页数： | 24/114页 |
| 文件大小： | 1623K |
| 代理商： | EP20K600EFC1020-1ES |
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Altera Corporation
17
APEX 20K Programmable Logic Device Family Data Sheet
LE Operating Modes
The APEX 20K LE can operate in one of the following three modes:
s
Normal mode
s
Arithmetic mode
s
Counter mode
Each mode uses LE resources differently. In each mode, seven available
inputs to the LE—the four data inputs from the LAB local interconnect,
the feedback from the programmable register, and the carry-in and
cascade-in from the previous LE—are directed to different destinations to
implement the desired logic function. LAB-wide signals provide clock,
asynchronous clear, asynchronous preset, asynchronous load,
synchronous clear, synchronous load, and clock enable control for the
register. These LAB-wide signals are available in all LE modes.
The Quartus II software, in conjunction with parameterized functions
such as LPM and DesignWare functions, automatically chooses the
appropriate mode for common functions such as counters, adders, and
multipliers. If required, the designer can also create special-purpose
functions that specify which LE operating mode to use for optimal
performance. Figure 8 shows the LE operating modes.
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PDF描述 |
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参数描述 |
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| EP20K600EFC1020-1X | 制造商:未知厂家 制造商全称:未知厂家 功能描述:FPGA |
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| EP20K600EFC1020-2ES | 制造商:未知厂家 制造商全称:未知厂家 功能描述:FPGA |
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