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参数资料
| 型号： | EP20K600EFC1020-1ES |
| 英文描述： | FPGA |
| 中文描述： | FPGA的 |
| 文件页数： | 96/114页 |
| 文件大小： | 1623K |
| 代理商： | EP20K600EFC1020-1ES |
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82
Altera Corporation
APEX 20K Programmable Logic Device Family Data Sheet
timing parameter values for EP20K100, EP20K200, and EP20K400
APEX 20K devices.
Table 46. EP20K400 fMAX Timing Parameters
Symbol
-1 Speed Grade
-2 Speed Grade
-3 Speed Grade
Min
Max
Min
Max
Min
Max
tSU
0.1
0.3
0.6
tH
0.5
0.8
0.9
tCO
0.1
0.4
0.6
tLUT
1.0
1.2
1.4
tESBRC
1.7
2.1
2.4
tESBWC
5.7
6.9
8.1
tESBWESU
3.3
3.9
4.6
tESBDATASU
2.2
2.7
3.1
tESBADDRSU
2.4
2.9
3.3
tESBDATACO1
1.3
1.6
1.8
tESBDATACO2
2.5
3.1
3.6
tESBDD
2.5
3.3
3.6
tPD
2.5
3.1
3.6
tPTERMSU
1.7
2.1
2.4
tPTERMCO
1.0
1.2
1.4
tF1-4
0.4
0.5
0.6
tF5-20
2.6
2.8
2.9
tF20+
3.7
3.8
3.9
tCH
2.0
2.5
3.0
tCL
2.0
2.5
3.0
tCLRP
0.5
0.6
0.8
tPREP
0.5
tESBCH
2.0
2.5
3.0
tESBCL
2.0
2.5
3.0
tESBWP
1.5
1.9
2.2
tESBRP
1.0
1.2
1.4
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