参数资料
型号: FDMA507PZ
厂商: Fairchild Semiconductor
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文件大小: 0K
描述: MOSFET P-CH 20V 6-MICROFET
标准包装: 1
系列: PowerTrench®
FET 型: MOSFET P 通道,金属氧化物
FET 特点: 逻辑电平门
漏极至源极电压(Vdss): 20V
电流 - 连续漏极(Id) @ 25° C: 7.8A
开态Rds(最大)@ Id, Vgs @ 25° C: 24 毫欧 @ 7.8A,5V
Id 时的 Vgs(th)(最大): 1.5V @ 250µA
闸电荷(Qg) @ Vgs: 42nC @ 5V
输入电容 (Ciss) @ Vds: 2015pF @ 10V
功率 - 最大: 900mW
安装类型: 表面贴装
封装/外壳: 6-WDFN 裸露焊盘
供应商设备封装: 6-MicroFET(2x2)
包装: 标准包装
其它名称: FDMA507PZDKR
Typical Characteristics T J = 25 °C unless otherwise noted
5
4
3
I D = -7.8 V
V DD = -8 V
V DD = -10 V
10000
1000
C iss
2
1
V DD = -12 V
f = 1 MHz
V GS = 0 V
C oss
C rss
0
0
10
20
30
40
100
0.1
1 10
20
Q g , GATE CHARGE(nC)
Figure 7. Gate Charge Characteristics
-V DS , DRAIN TO SOURCE VOLTAGE (V)
Figure 8. Capacitance vs Drain
to Source Voltage
10
10
-1
-2
V GS = 0 V
50
10
10
-3
-4
10
100 us
1 ms
10
-5
T J = 125 o C
1
10 ms
10
10
10
10
-6
-7
-8
-9
T J = 25 o C
0.1
THIS AREA IS
LIMITEDBY r DS(on)
SINGLE PULSE
TJ = MAX RATED
R θ JA = 145 o C/W
TA = 25 o C
100 ms
1s
10 s
DC
10
-10
0
3
6
9
12
15
0.01
0.1
1
10
80
-V GS, GATE TO SOURCE VOLTAGE (V)
Figure 9. Gate Leakage Current vs Gate to
Source Voltage
-V DS , DRAIN to SOURCE VOLTAGE (V)
Figure 10. Forward Bias Safe
Operating Area
1000
SINGLE PULSE
R θ JA = 145 o C/W
T A = 25 C
100
10
1
o
10
10
10
10
0.5
-4
-3
-2
-1
1
10
100
1000
t, PULSE WIDTH (sec)
Figure 11. Single Pulse Maximum Power Dissipation
?2010 Fairchild Semiconductor Corporation
FDMA507PZ Rev.C
4
www.fairchildsemi.com
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