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参数资料
| 型号： | HW-V5-ML550-UNI-G |
| 厂商： | Xilinx Inc |
| 文件页数： | 40/88页 |
| 文件大小： | 0K |
| 描述： | EVALUATION PLATFORM VIRTEX-5 |
| 产品变化通告： | Adapter Replacement 23/May/2008 Development Systems Discontinuation 26/Apr/2011 |
| 标准包装： | 1 |
| 系列： | Virtex®-5 LXT |
| 类型： | FPGA |
| 适用于相关产品： | XC5VLX50T-FFG1136 |
| 所含物品： | 开发平台，电源，回送板，小型闪存卡，软件和文档 |
| 相关产品： | XC5VLX50T-3FFG665C-ND - IC FPGA VIRTEX-5 50K 665FCBGA XC5VLX50T-3FFG1136C-ND - IC FPGA VIRTEX-5 50K 1136FBGA XC5VLX50T-3FF665C-ND - IC FPGA VIRTEX-5 50K 665FCBGA XC5VLX50T-3FF1136C-ND - IC FPGA VIRTEX-5 50K 1136FBGA XC5VLX50T-2FFG665I-ND - IC FPGA VIRTEX-5 50K 665FCBGA XC5VLX50T-2FFG665C-ND - IC FPGA VIRTEX-5 50K 665FCBGA XC5VLX50T-2FFG1136I-ND - IC FPGA VIRTEX-5 50K 1136FBGA XC5VLX50T-2FFG1136C-ND - IC FPGA VIRTEX-5 50K 1136FBGA XC5VLX50T-2FF665I-ND - IC FPGA VIRTEX-5 50K 665FCBGA XC5VLX50T-2FF665C-ND - IC FPGA VIRTEX-5 50K 665FCBGA 更多... |
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Chapter 3: Hardware Description
2.5V V REF System Monitor
R
VCC2V5_VAUX
HDR_1X 3 _RA
VCC5
L2
P 3 9
HZ0 8 05E601R-00
3
2
1
L4
HZ0 8 05E601R-00
VCC5_ S Y S MON_TAP
19,R2 8 2.2
1
2
1
C91 1
C92
1
2
19,C 3 05.1
3 0,U9.T1 8
3 0,J19. 8
19,U11.4
S M_AVDD
REF_2V5_OUT
2
1μF
2
A
0.1μF
MAX604 3 not
3 0,J19.7
a v a il ab le in LF/RoH S
3 0,U9.V1 8
L1
HZ0 8 05E601R-00
S M_VREF_P
1 2
3
OUT
AGND
IN
2
1
C94
0.1μF
1
2
U10
TI_REF 3 025_LF
S OT2 3 - 3
1
2
C99
1μF
A
UG202_ 3 _19_04150 8
Figure 3-19:
System Monitor 2.5V Reference Selection using P39 (Sheet 19)
P39 is a 3-pin male right-angle header with pins on 0.1-inch centers. The right-angle pins
face Samtec connector P73. Depending on the length of the P39 pins, it could be difficult to
install/remove the 2-pin jumper block used to select the SM_AVDD voltage on the P39.2
center pin.
To alleviate any mechanical interference between the 2-pin jumper block and the body of
P73, P39 pins can be clipped shorter or bent slightly upwards to permit the 2-pin jumper
block to pass above the body of P73.
P39 must be a right-angle header to keep its profile beneath the LVDS Loopback board
whenever it is installed across the Samtec LVDS connectors.
System Monitor users should install the 2-pin shunt across P39 pins 1 - 2 to select the
precision 2.5V U10 REF3025 output (see Table 3-14 ).
Table 3-14:
P39 Pins
1-2
2-3
System Monitor 2.5V AVDD Reference Options
Selected Reference Voltage
U10 TI REF3025 precision 2.5V reference
Filtered 2.5V V AUX FPGA power plane
40
ML550 Networking Interfaces Platform
UG202 (v1.4) April 18, 2008
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PDF描述 |
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| HW-V5-ML561-UNI-G | EVALUATION PLATFORM VIRTEX-5 |
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| IAC24A | INPUT MODULE AC 5MA 24VDC |
| IAC5EQ | INPUT MODULE AC 10MA 5VDC |
相关代理商/技术参数 |
参数描述 |
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