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参数资料
型号： HW-V5-ML550-UNI-G
厂商： Xilinx Inc
文件页数： 51/88页
文件大小： 0K
描述： EVALUATION PLATFORM VIRTEX-5
产品变化通告： Adapter Replacement 23/May/2008
Development Systems Discontinuation 26/Apr/2011
标准包装： 1
系列： Virtex®-5 LXT
类型： FPGA
适用于相关产品： XC5VLX50T-FFG1136
所含物品： 开发平台，电源，回送板，小型闪存卡，软件和文档
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R
Appendix A
LVDS
This appendix provides the pinouts for the six LVDS connectors.
LVDS Transmit Connectors
Table A-1 lists the connections for LVDS transmit connector #1 (P73), Table A-2 lists the
connections for LVDS transmit connector #2 (P46), and Table A-3 lists the connections for
LVDS transmit connector #3 (P49). These connectors and their associated FPGA banks are
detailed on ML550 0381218 schematic pages 6, 7, and 8.
The clock multiplier U16 connections are shown in Table A-2 and associated with P46 on
schematic page 7. The multiply and divide circuitry (detailed on schematic sheet 12) is
discussed in “LVDS Connectors,” page 28 .
Table A-1:
LVDS Transmit Connector #1 (P73)
P73
Pin #
TX Signal Name
U9
Pin #
U9
Bank #
P73
Pin #
TX Signal Name
U9
Pin #
U9
Bank #
1
2
NC
NC
45
46
GND
GND
3
4
5
6
7
8
9
10
11
12
13
14
15
16
NC
NC
GND
GND
NC
NC
NC
NC
GND
GND
NC
NC
NC
NC
47
48
49
50
51
52
53
54
55
56
57
58
59
60
LVDS_DATAOUT_11N
LVDS_DATAOUT_CLKCAP_10N
LVDS_DATAOUT_11P
LVDS_DATAOUT_CLKCAP_10P
GND
GND
LVDS_DATAOUT_CLKCAP_09N
LVDS_DATAOUT_CLKCAP_08N
LVDS_DATAOUT_CLKCAP_09P
LVDS_DATAOUT_CLKCAP_08P
GND
GND
LVDS_DATAOUT_07N
LVDS_DATAOUT_06N
W26
Y29
Y26
Y28
AA31
AA30
AB31
AA29
AC29
AF30
17
17
17
17
17
17
17
17
17
17
ML550 Networking Interfaces Platform
UG202 (v1.4) April 18, 2008
www.xilinx.com
51
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PDF描述
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HW-V5-ML561-UNI-G EVALUATION PLATFORM VIRTEX-5
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