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参数资料
| 型号： | HW-V5-ML550-UNI-G |
| 厂商： | Xilinx Inc |
| 文件页数： | 81/88页 |
| 文件大小： | 0K |
| 描述： | EVALUATION PLATFORM VIRTEX-5 |
| 产品变化通告： | Adapter Replacement 23/May/2008 Development Systems Discontinuation 26/Apr/2011 |
| 标准包装： | 1 |
| 系列： | Virtex®-5 LXT |
| 类型： | FPGA |
| 适用于相关产品： | XC5VLX50T-FFG1136 |
| 所含物品： | 开发平台，电源，回送板，小型闪存卡，软件和文档 |
| 相关产品： | XC5VLX50T-3FFG665C-ND - IC FPGA VIRTEX-5 50K 665FCBGA XC5VLX50T-3FFG1136C-ND - IC FPGA VIRTEX-5 50K 1136FBGA XC5VLX50T-3FF665C-ND - IC FPGA VIRTEX-5 50K 665FCBGA XC5VLX50T-3FF1136C-ND - IC FPGA VIRTEX-5 50K 1136FBGA XC5VLX50T-2FFG665I-ND - IC FPGA VIRTEX-5 50K 665FCBGA XC5VLX50T-2FFG665C-ND - IC FPGA VIRTEX-5 50K 665FCBGA XC5VLX50T-2FFG1136I-ND - IC FPGA VIRTEX-5 50K 1136FBGA XC5VLX50T-2FFG1136C-ND - IC FPGA VIRTEX-5 50K 1136FBGA XC5VLX50T-2FF665I-ND - IC FPGA VIRTEX-5 50K 665FCBGA XC5VLX50T-2FF665C-ND - IC FPGA VIRTEX-5 50K 665FCBGA 更多... |
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R
RData (8+gnd)
DataIn (8)
Hardware Schematic Diagram
DataOut (8)
DB (8)
WData (32+4)
IorD = '1' Instruction
IorD (bit 9)
Address
Write
Enable
Clock
'0' Data
Addr
read
ena
Clock
CS1B
RS
RW
E
Clock
Block RAM
Reset
E
Clock
TC
State
Machine
Clock
Reset
Design for Full Graphics Interface, Attached to CoreConnect Bus
UG202_C_08_050906
Figure C-8:
General Block Diagram of Panel in Full Graphics Mode
LCD Panel Used in Character Mode
This design example requires a byte representing a command or data to be displayed as
input.
?
?
?
When the Enable signal is Low, nothing happens. The display interface design is
locked.
When the Enable signal is High and the “data_or_command” control signal is Low,
the byte written is a display command.
When the Enable signal and the data_or_command control signal are High, the byte
written is the ASCII character code of the character to be put on the display.
Display Command Byte
When the LCD interface is enabled for the first time, a set of command bytes is sent to the
LCD. This command set provides the basic initialization of the LCD display controller.
When this initialization is done, the normal LCD display interface is freed for normal use.
Command bytes from the valid command set can be sent to the display (controller).
A detailed description of the LCD controller interface can be found in the
Toplevel.vhd.txt file.
ML550 Networking Interfaces Platform
UG202 (v1.4) April 18, 2008
81
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PDF描述 |
|---|---|
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| HW-V5-ML561-UNI-G | EVALUATION PLATFORM VIRTEX-5 |
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| IAC24A | INPUT MODULE AC 5MA 24VDC |
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参数描述 |
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