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参数资料
| 型号： | HW-V5-ML550-UNI-G |
| 厂商： | Xilinx Inc |
| 文件页数： | 75/88页 |
| 文件大小： | 0K |
| 描述： | EVALUATION PLATFORM VIRTEX-5 |
| 产品变化通告： | Adapter Replacement 23/May/2008 Development Systems Discontinuation 26/Apr/2011 |
| 标准包装： | 1 |
| 系列： | Virtex®-5 LXT |
| 类型： | FPGA |
| 适用于相关产品： | XC5VLX50T-FFG1136 |
| 所含物品： | 开发平台，电源，回送板，小型闪存卡，软件和文档 |
| 相关产品： | XC5VLX50T-3FFG665C-ND - IC FPGA VIRTEX-5 50K 665FCBGA XC5VLX50T-3FFG1136C-ND - IC FPGA VIRTEX-5 50K 1136FBGA XC5VLX50T-3FF665C-ND - IC FPGA VIRTEX-5 50K 665FCBGA XC5VLX50T-3FF1136C-ND - IC FPGA VIRTEX-5 50K 1136FBGA XC5VLX50T-2FFG665I-ND - IC FPGA VIRTEX-5 50K 665FCBGA XC5VLX50T-2FFG665C-ND - IC FPGA VIRTEX-5 50K 665FCBGA XC5VLX50T-2FFG1136I-ND - IC FPGA VIRTEX-5 50K 1136FBGA XC5VLX50T-2FFG1136C-ND - IC FPGA VIRTEX-5 50K 1136FBGA XC5VLX50T-2FF665I-ND - IC FPGA VIRTEX-5 50K 665FCBGA XC5VLX50T-2FF665C-ND - IC FPGA VIRTEX-5 50K 665FCBGA 更多... |
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R
?
Hardware Schematic Diagram
When SHL is set to 1 , the common lines are scanned in opposite direction.
Once configured, these settings normally are not changed.
?
Select the LCD bias settings.
?
?
The duty cycle is selected as 1/65 by hardwiring the controller IC pads on the
display PCB.
The LCD bias is set to:
-
-
1/7: when the BIAS bit is 0
1/9: when the BIAS bit is 1
The following steps are performed next:
?
?
?
Start the onboard converter, regulator, and follower
Table C-5:
Resistor Value Settings
3-Bit Data Settings (R2 R1 R0)
000
001
010
011
100
101
110
111
1+(Rb/Ra)
1.90
2.19
2.55
3.02
3.61
4.35
5.29
6.48
Table C-6:
Reference Voltage Parameters
SV5
0
0
..
..
1
1
SV4
0
0
..
..
1
1
SV3
0
0
…
..
1
1
SV2
0
0
..
..
1
1
SV1
0
0
..
..
1
1
SV0
0
1
..
..
0
1
Reference Voltage Parameter ( α )
0
1
..
..
62
63
At startup of the LCD controller (after RESETB operation), the resistor and reference
voltage values are:
?
?
Resistor selection is: 0,0,0
Reference voltage is: 1,0,0,0,0,0
The Resistor selection value MUST be set to 101b when using this LCD panel.
After the display is brought to operational mode, it is best to wait at least 1 ms to ensure the
stabilization of power supply levels. After this time, all other necessary display
initializations can be performed.
ML550 Networking Interfaces Platform
UG202 (v1.4) April 18, 2008
75
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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