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参数资料
| 型号： | IDT70T653MS15BC8 |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 15/24页 |
| 文件大小： | 0K |
| 描述： | IC SRAM 18MBIT 15NS 256BGA |
| 标准包装： | 1,000 |
| 格式 - 存储器： | RAM |
| 存储器类型： | SRAM - 双端口，异步 |
| 存储容量： | 18M（512K x 36） |
| 速度： | 15ns |
| 接口： | 并联 |
| 电源电压： | 2.4 V ~ 2.6 V |
| 工作温度： | 0°C ~ 70°C |
| 封装/外壳： | 256-LBGA |
| 供应商设备封装： | 256-CABGA（17x17） |
| 包装： | 带卷 (TR) |
| 其它名称： | 70T653MS15BC8 |
IDT70T653M
High-Speed 2.5V 512K x 36 Asynchronous Dual-Port Static RAM
Industrial and Commercial Temperature Ranges
AC Electrical Characteristics Over the
Operating Temperature and Supply Voltage Range
70T653MS10
Com'l Only
70T653MS12
Com'l
& Ind
70T653MS15
Com'l Only
Symbol
Parameter
Unit
Min.
Max.
Min.
Max.
Min.
Max.
BUSY TIMING
t WB
t WH
BUSY Input to Write (4)
Write Hold After BUSY (5)
0
7
____
____
0
9
____
____
0
12
____
____
ns
ns
PORT-TO-PORT DELAY TIMING
t WDD
Write Pulse to Data Delay (1)
____
14
____
16
____
20
ns
t DDD
Write Data Valid to Read Data Delay
(1)
____
14
____
16
____
20
ns
5679 tbl 15
NOTES:
1. Port-to-port delay through RAM cells from writing port to reading port, refer to Timing Waveform of Write with Port-to-Port Read.
2. To ensure that the earlier of the two ports wins.
3. t BDD is a calculated parameter and is the greater of the Max. spec, t WDD – t WP (actual), or t DDD – t DW (actual).
4. To ensure that the write cycle is inhibited on port "B" during contention on port "A".
5. To ensure that a write cycle is completed on port "B" after contention on port "A".
AC Electrical Characteristics Over the
Operating Temperature and Supply Voltage Range (1,2,3)
Symbol
Parameter
70T65M3S10
Com'l Only
70T653MS12
Com'l
& Ind
70T6539MS15
Com'l Only
Min.
Max.
Min.
Max.
Min.
Max.
SLEEP MODE TIMING (ZZx=V IH )
t ZZS
t ZZR
t ZZPD
t ZZPU
Sleep Mode Set Time
Sleep Mode Reset Time
Sleep Mode Power Down Time (4)
Sleep Mode Power Up Time (4)
10
10
10
____
____
____
____
0
12
12
12
____
____
____
____
0
15
15
15
____
____
____
____
0
NOTES:
5679 tbl 15a
1. Timing is the same for both ports.
2. The sleep mode pin shuts off all dynamic inputs, except JTAG inputs, when asserted. OPTx, INT x and the sleep mode pins themselves (ZZx) are not affected
during sleep mode. It is recommended that boundary scan not be operated during sleep mode.
3. These values are valid regardless of the power supply level selected for I/O and control signals (3.3V/2.5V). See page 6 for details.
4. This parameter is guaranteed by device characterization, but is not production tested.
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