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参数资料
| 型号： | IDT70T653MS15BC8 |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 22/24页 |
| 文件大小： | 0K |
| 描述： | IC SRAM 18MBIT 15NS 256BGA |
| 标准包装： | 1,000 |
| 格式 - 存储器： | RAM |
| 存储器类型： | SRAM - 双端口，异步 |
| 存储容量： | 18M（512K x 36） |
| 速度： | 15ns |
| 接口： | 并联 |
| 电源电压： | 2.4 V ~ 2.6 V |
| 工作温度： | 0°C ~ 70°C |
| 封装/外壳： | 256-LBGA |
| 供应商设备封装： | 256-CABGA（17x17） |
| 包装： | 带卷 (TR) |
| 其它名称： | 70T653MS15BC8 |
IDT70T653M
High-Speed 2.5V 512K x 36 Asynchronous Dual-Port Static RAM
JTAG Timing Specifications
t JCYC
Industrial and Commercial Temperature Ranges
t JF
t JCL
t JR
t JCH
TCK
Device Inputs (1) /
TDI/TMS
Device Outputs (2) /
t JS
t JH
t JDC
TDO
TRST
t JRSR
t JCD
x
5679 drw 24
t JRST
NOTES:
1. Device inputs = All device inputs except TDI, TMS, TCK and TRST .
2. Device outputs = All device outputs except TDO.
JTAG AC Electrical
Characteristics (1,2,3,4,5)
70T653M
3
3
Symbol
t JCYC
t JCH
t JCL
t JR
t JF
t JRST
Parameter
JTAG Clock Input Period
JTAG Clock HIGH
JTAG Clock Low
JTAG Clock Rise Time
JTAG Clock Fall Time
JTAG Reset
Min.
100
40
40
____
____
50
Max.
____
____
____
(1)
(1)
____
Units
ns
ns
ns
ns
ns
ns
t JRSR
t JCD
JTAG Reset Recovery
JTAG Data Output
50
____
____
25
ns
ns
NOTES:
1. Guaranteed by design.
2. 30pF loading on external output signals.
t JDC
t JS
t JH
JTAG Data Output Hold
JTAG Setup
JTAG Hold
0
15
15
____
____
____
ns
ns
ns
3. Refer to AC Electrical Test Conditions stated earlier in this document.
4. JTAG operations occur at one speed (10MHz). The base device may run at any
speed specified in this datasheet.
5. JTAG cannot be tested in sleep mode.
5679 tbl 20
22
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