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参数资料
| 型号： | IDT82V2042EPFG |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 40/83页 |
| 文件大小： | 0K |
| 描述： | IC LIU T1/J1/E1 2CH SHORT 80TQFP |
| 标准包装： | 45 |
| 类型： | 线路接口装置（LIU） |
| 规程： | E1 |
| 电源电压： | 3.13 V ~ 3.47 V |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 80-LQFP |
| 供应商设备封装： | 80-TQFP（14x14） |
| 包装： | 托盘 |
| 其它名称： | 82V2042EPFG |
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IDT82V2042E
DUAL CHANNEL T1/E1/J1 SHORT HAUL LINE INTERFACE UNIT
PROGRAMMING INFORMATION
45
December 12, 2005
4.3.2
TRANSMIT AND RECEIVE TERMINATION REGISTER
4.3.3
JITTER ATTENUATION CONTROL REGISTER
Table-25 TERM: Transmit and Receive Termination Configuration Register
(R/W, Address = 02H, 22H)
Symbol
Bit
Default
Description
-
7-6
00
Reserved.
T_TERM[2:0]
5-3
000
These bits select the internal termination for transmit line impedance matching.
= 000: Internal 75
impedance matching
= 001: Internal 120
impedance matching
= 010: Internal 100
impedance matching
= 011: Internal 110
impedance matching
= 1xx: Selects external impedance matching resistors for E1 mode only. T1/J1 does not require external impedance
resistors (see Table-10).
R_TERM[2:0]
2-0
000
These bits select the internal termination for receive line impedance matching.
= 000: Internal 75
impedance matching
= 001: Internal 120
impedance matching
= 010: Internal 100
impedance matching
= 011: Internal 110
impedance matching
= 1xx: Selects external impedance matching resistors (see Table-11).
Table-26 JACF: Jitter Attenuation Configuration Register
(R/W, Address = 03H, 23H)
Symbol
Bit
Default
Description
-
7-6
00
Reserved.
JA_LIMIT
5
1
= 0: Normal mode
= 1: JA limit mode
JACF[1:0]
4-3
00
Jitter Attenuation configuration
= 00/10: JA not used
= 01: JA in transmit path
= 11: JA in receive path
JADP[1:0]
2-1
00
Jitter Attenuation depth select
= 00: 128 bits
= 01: 64 bits
= 1x: 32 bits
JABW
0
Jitter transfer function bandwidth select
= 0: 6.8 Hz (E1)
5 Hz (T1/J1)
= 1: 0.9 Hz (E1)
1.25 Hz (T1/J1)
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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