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参数资料
型号： IDT82V2108PX8
厂商： IDT, Integrated Device Technology Inc
文件页数： 163/292页
文件大小： 0K
描述： IC FRAMER T1/J1/E1 8CH 128-PQFP
标准包装： 500
控制器类型： T1/E1/J1 调帧器
接口： 并联
电源电压： 2.97 V ~ 3.63 V
电流 - 电源： 160mA
工作温度： -40°C ~ 85°C
安装类型： 表面贴装
封装/外壳： 128-BFQFP
供应商设备封装： 128-PQFP（14x20）
包装： 带卷 (TR)
其它名称： 82V2108PX8
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IDT82V2108
T1 / E1 / J1 OCTAL FRAMER
Programming Information
235
March 5, 2009
ZCS[1:0]:
The priority of the TPLC operation on the TSDn/MTSD pin from high to low is:
Extract data to PRGD for test; Zero Code Suppression; Payload loopback; Replace the data with the milliwatt pattern; Replace the data with the
pattern generated in the PRGD; Replace the data with the value in the IDLE[7:0]; Invert the bit.
T1 / J1 TPLC IDLE Code Byte Registers (TPLC Indirect Registers 19H ~ 30H)
They contain the data that will replace the data input from the TSDn/MTSD pin when the corresponding IDLE_DS0 is logic 1. IDLE7 is the MSB.
T1 / J1 TPLC Signaling Control Byte Registers (TPLC Indirect Registers 31H ~ 48H)
SIGC0:
This bit is valid when the corresponding SIGC1 is logic 1.
= 0: Use the data input from the TSSIGn/MTSSIG pin as the signaling.
= 1: Use the data in the A, B, C, D as the signaling.
SIGC1:
= 0: Disable replacing the signaling bit with the data input from the TSSIGn/MTSSIG pin or the data in the A, B, C, D.
= 1: Enable replacing the signaling bit with the data input from the TSSIGn/MTSSIG pin or the data in the A, B, C, D.
A, B, C, D:
They contain the data that can be used as signaling when the corresponding SIGC0 is logic 1. They are in the least significant nibble.
ZCS[1:0]
Per-Channel Zero Code Suppression
0 0
No zero code suppression.
0 1
Every bit 8 in the corresponding channel is forced to be logic one.
1 0
GTE Zero Code Suppression - Every bit 8 (or bit 7 in signaling frames) is forced to be logic one when the bits in the corresponding channel are all ‘Zero’s.
1 1
Bell Zero Code Suppression - Every bit 7 is forced to be logic one when the bits in the corresponding channel are all ‘Zero’s.
Bit No.
7
6
5
4
3
2
1
0
Bit Name
IDLE7
IDLE6
IDLE5
IDLE4
IDLE3
IDLE2
IDLE1
IDLE0
Type
R/W
Default
XX
X
Bit No.
7
6
5
4
3
2
1
0
Bit Name
SIGC0
SIGC1
Reserved
AB
C
D
Type
R/W
Default
XX
X
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PDF描述
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