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参数资料
型号： IDT82V2108PX8
厂商： IDT, Integrated Device Technology Inc
文件页数： 26/292页
文件大小： 0K
描述： IC FRAMER T1/J1/E1 8CH 128-PQFP
标准包装： 500
控制器类型： T1/E1/J1 调帧器
接口： 并联
电源电压： 2.97 V ~ 3.63 V
电流 - 电源： 160mA
工作温度： -40°C ~ 85°C
安装类型： 表面贴装
封装/外壳： 128-BFQFP
供应商设备封装： 128-PQFP（14x20）
包装： 带卷 (TR)
其它名称： 82V2108PX8
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IDT82V2108
T1 / E1 / J1 OCTAL FRAMER
Operation
111
March 5, 2009
Receive Multi-
plexed Mode
(Continued)
02CH
00010000
The Alarm Detector is set in the ESF format.
0ACH
00010000
12CH
00010000
1ACH
00010000
22CH
00010000
2ACH
00010000
32CH
00010000
3ACH
00010000
040H
00000100
The Receive CAS/RBS Buffer is set in the ESF format.
0C0H
00000100
140H
00000100
1C0H
00000100
240H
00000100
2C0H
00000100
340H
00000100
3C0H
00000100
Note:
1. In the ‘Register’ column, except for the Receive/Transmit Multiplexed mode, the register position of Framer 1 is listed to represent the set of the registers of eight framers. The other
registers positions are tabulated in the ‘Register Map’. However, in the Receive/Transmit Multiplexed mode, the registers positions of eight framers are all listed.
2. The ‘Description’ illustrates the fundamental function of the operation mode. The others can be configured as desired.
Table 52: Various Operation Modes in Receive Path for Reference (Continued)
Mode
Register 1
Value (from Bit7 to Bit0)
Description 2
Table 53: Various Operation Modes in Transmit Path for Reference
Mode
Register 1
Value (from Bit7 to Bit0)
Description 2
Transmit Clock
Slave TSFS
Enable Mode
004H
00001000
The data on the TSDn and TSCFS pins is sampled on the falling edge of TSCCKB. The data on
TSFSn is updated on the falling edge of TSCCKB.
005H
10000000
In the Transmit Clock Slave TSFS Enabled mode. The backplane rate is 1.544 Mbit/s.
044H
00010000
The Frame Generator is set in the ESF format.
007H
00001101
TSCCKB is selected as the TJAT input reference clock. Smoothed clock is selected as Line Transmit
Clock (LTCK).
01BH
00010000
The FIFO is set to self-center its read pointer.
Transmit Clock
Slave External
Signaling Mode
(1.544 Mbit/s)
004H
00001000
The data on the TSDn, TSSIGn and TSCFS pins is sampled on the falling edge of TSCCKB.
005H
11000000
In the Transmit Clock Slave External Signaling mode. The backplane rate is 1.544 Mbit/s.
044H
00010000
The Frame Generator is set in the ESF format.
007H
00001101
TSCCKB is selected as TJAT input reference clock. Smoothed clock is selected as Line Transmit
Clock (LTCK).
01BH
00010000
The FIFO is set to self-center its read pointer.
Transmit Clock
Slave External
Signaling Mode
(2.048 Mbit/s)
004H
00001000
The data on the TSDn, TSSIGn and TSCFS pins is sampled on the falling edge of TSCCKB.
005H
11000100
In the Transmit Clock Slave External Signaling mode. The backplane rate is 2.048 Mbit/s.
044H
00010000
The Frame Generator is set in the ESF format.
007H
00001101
TSCCKB is selected as the TJAT input reference clock. Smoothed clock is selected as Line Transmit
Clock (LTCK).
019H
11111111
Set the Reference Clock Divisor(N1) to ‘255’.
01AH
11000000
Set the Output Clock Divisor(N2) to ‘192’.
01BH
00010000
The FIFO is set to self-center its read pointer.
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