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参数资料
型号： IDT82V2108PX8
厂商： IDT, Integrated Device Technology Inc
文件页数： 8/292页
文件大小： 0K
描述： IC FRAMER T1/J1/E1 8CH 128-PQFP
标准包装： 500
控制器类型： T1/E1/J1 调帧器
接口： 并联
电源电压： 2.97 V ~ 3.63 V
电流 - 电源： 160mA
工作温度： -40°C ~ 85°C
安装类型： 表面贴装
封装/外壳： 128-BFQFP
供应商设备封装： 128-PQFP（14x20）
包装： 带卷 (TR)
其它名称： 82V2108PX8
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IDT82V2108
T1 / E1 / J1 OCTAL FRAMER
Operation
95
March 5, 2009
4.1.2
VARIOUS OPERATION MODES CONFIGURATION
Five operation modes can be set in the receive path and four oper-
ation modes can be set in the transmit path. In each operation mode, the
configurations in Table 41 and Table 42 are illustrated for reference.
Table 41: Various Operation Modes in Receive Path for Reference
Mode
Register 1
Value (from Bit7 to Bit0)
Description 2
Receive Clock
Slave RSCK Ref-
erence Mode
001H
00000000
In the Receive Clock Slave RSCK Reference mode. RSCK is 8 KHZ.
00EH
00001000
The output on the RSFSn pin is determined by the ROHM, BRXSMFP, BRCMFP and ALTIFP.
010H
00100001
In the Receive Clock Slave mode. The FE and DE are both 0. The receive backplane rate is
2.048 Mbit/s.
011H
00100000
RSCFS is used.
012H
00000001
Enable the normal operation of the RSDn pin.
Receive Clock
Slave External
Signaling Mode
001H
01000000
In the Receive Clock Slave External Signaling mode.
00EH
00001000
The output on the RSFSn pin is determined by the ROHM, BRXSMFP, BRCMFP and ALTIFP.
010H
00100001
In the Receive Clock Slave mode. The FE and DE are both 0. The receive backplane rate is
2.048 Mbit/s.
011H
00100000
RSCFS is used.
012H
00000001
Enable the normal operation of the RSDn and RSSIGn pins.
Receive Clock
Master Full E1
010H
00001001
In the Receive Clock Master Full E1 Mode. The FE is logic 1 and the DE is logic 0.
011H
00000000
RSCFS is un-used.
012H
00000001
Enable the normal operation of the RSDn pin.
Receive Clock
Master Fractional
E1 Mode
010H
10001001
In the Receive Clock Master Nx64K Mode. The FE is logic 1 and the DE is logic 0.
011H
00000000
RSCFS is un-used.
012H
00000001
Enable the normal operation of the RSDn pin.
05CH
00000011
Enable the Receive Payload Control.
20H - 3FH (RPLC
indirect registers)
01000000
The code in the DTRK[7:0] replaces the data output on the RSDn pin in the corresponding
channel.
Receive Multi-
plexed Mode
001H
01001000
Multiplex the data stream of these four framers to the multiplexed bus 1.
081H
01001000
101H
01001000
181H
01001000
201H
01011000
Multiplex the data stream of these four framers to the multiplexed bus 2.
281H
01011000
301H
01011000
381H
01011000
010H
00111011
In Receive Multiplexed mode. The receive backplane rate is 8.192Mbit/s. The FE
is logic 1 and the DE is logic 1.
090H
00111011
110H
00111011
190H
00111011
210H
00111011
290H
00111011
310H
00111011
390H
00111011
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