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参数资料
| 型号： | IPT-C2H-NIOS |
| 厂商： | Altera |
| 文件页数： | 88/138页 |
| 文件大小： | 0K |
| 描述： | C2H COMPILER FOR NIOS II |
| 标准包装： | 1 |
| 系列： | Nios®II |
| 类型： | Nios II |
| 功能： | C 到硬件编译器 |
| 许可证： | 初始许可证 |
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Scheduling
State 1 in Figure 3–24 remains empty because list has two cycles of read
latency. The loop-carried dependencies on variables sum and list are
ideal cases, which do not impose restrictions on the pipeline scheduling.
Figure 3–25 illustrates how the C2H Compiler schedules successive
iterations of the loop.
Figure 3–25. Pipelined Loop Iterations Reading Memory with Latency
As shown in Figure 3–25 , the C2H Compiler is able to start a new iteration
of the loop immediately after the prior iteration completes State 0. At
Time 1, Iteration 1 starts a new read access from list , even though data
from list hasn't returned for Iteration 0. Due to the two cycles of read
latency, at any given time, there can be a maximum of two pending read
operations.
Over successive iterations of a loop, the C2H Compiler hides the memory
latency by pipelining the read transfers. Although multiple cycles of
latency are required to fill the pipeline, successive iterations can complete
at a rate of one per clock cycle, assuming no stalling occurs (see section
“Stalling” on page 3–39 ).
3–48
Nios II C2H Compiler User Guide
9.1
Altera Corporation
November 2009
相关PDF资料 |
PDF描述 |
|---|---|
| IPTR-DSPBUILDER | DSP BUILDER SOFTWARE |
| IR11662SPBF | IC CNTROL SMART RECTIFIER 8-SOIC |
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| IR11672ASPBF | IC MOSFET DRIVER 200V 8-SOIC |
| IR1167ASTRPBF | IC SMART SECONDARY DRIVER 8-SOIC |
相关代理商/技术参数 |
参数描述 |
|---|---|
| IPT-DSPBUILDER | 功能描述:开发软件 DSP Builder MATLAB SIMULINK RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IPTE-75GF-1000-70D | 制造商: 功能描述: 制造商:undefined 功能描述: |
| IPTG06A18-11SZC | 制造商:GLENAIR 制造商全称:Glenair, Inc. 功能描述:Straight Plug Connector with Backshell to Accommodate |
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| IPTG06A18-11SZCPHM18 | 制造商:GLENAIR 制造商全称:Glenair, Inc. 功能描述:Straight Plug Connector |
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