参数资料
| 型号： | ISL6328ACRZ |
| 厂商： | Intersil |
| 文件页数： | 11/33页 |
| 文件大小： | 0K |
| 描述： | IC VOLTAGE REGULATOR |
| 标准包装： | 50 |
| 系列： | * |
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ISL6328A
Electrical Specifications
Boldface limits apply over the operating temperature range. (Continued)
MIN
MAX
PARAMETER
TEST CONDITIONS
(Note 6)
TYP
(Note 6)
UNITS
POWER GOOD
Overvoltage Threshold
VSEN Rising
VDAC +
VDAC +
V
220mV
325mV
Undervoltage Threshold
VSEN Falling
VDAC -
VDAC -
mV
345mV
190mV
Power-Good Hysteresis
OVERVOLTAGE PROTECTION
50
mV
OVP Trip Level
V DAC = 1.1V
1.75
1.79
1.85
V
OVP Lower Gate Release Threshold
0.35
V
UGATE Rise Time
LGATE Rise Time
UGATE Fall Time
LGATE Fall Time
UGATE Turn-On Non-overlap
LGATE Turn-On Non-overlap
t RUGATE; V PVCC = 8V, 3nF Load, 10% to 90%
t RLGATE; V PVCC = 8V, 3nF Load, 10% to 90%
t FUGATE; V PVCC = 12V, 3nF Load, 90% to 10%
t FLGATE; V PVCC = 12V, 3nF Load, 90% to 10%
t PDHUGATE ; V PVCC = 12V, 3nF Load, Adaptive
t PDHLGATE ; V PVCC = 12V, 3nF Load, Adaptive
26
18
18
12
10
10
ns
ns
ns
ns
ns
ns
GATE DRIVE RESISTANCE
Upper Drive Source Resistance
Upper Drive Sink Resistance
Lower Drive Source Resistance
Lower Drive Sink Resistance
V PVCC = 12V, 15mA Source Current
V PVCC = 12V, 15mA Sink Current
V PVCC = 12V, 15mA Source Current
V PVCC = 12V, 15mA Sink Current
2.5
2.0
1.6
1.1
Ω
Ω
Ω
Ω
SVI INTERFACE
SVC, SVD Input HIGH (VIH)
SVC, SVD Input LOW (VIL)
SVC, SVD Input HIGH (VIH)
SVC, SVD Input LOW (VIL)
SVD Low Level Output Voltage
SVC, SVD Leakage (Note 7)
FS resistor tied to GND
FS resistor tied to GND
FS resistor tied to VCC
FS resistor tied to VCC
510 Ω Resistor to 1.8V
0.85
1.05
0.45
0.55
0.4
±5
V
V
V
V
V
μA
NOTES:
6. Parameters with MIN and/or MAX limits are 100% tested at +25°C, unless otherwise specified. Temperature limits established by characterization
and are not production tested.
7. Limits should be considered typical and are not production tested.
11
FN7986.0
April 6, 2012
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PDF描述 |
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参数描述 |
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