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参数资料
型号： MC56F8122VFAE
厂商： Freescale Semiconductor
文件页数： 19/136页
文件大小： 0K
描述： IC DSP 16BIT 40MHZ 48-LQFP
标准包装： 250
系列： 56F8xxx
核心处理器： 56800E
芯体尺寸： 16-位
速度： 40MHz
连通性： SCI，SPI
外围设备： POR，WDT
输入/输出数： 21
程序存储器容量： 32KB（16K x 16）
程序存储器类型： 闪存
RAM 容量： 4K x 16
电压 - 电源 (Vcc/Vdd)： 2.25 V ~ 3.6 V
数据转换器： A/D 6x12b
振荡器型： 内部
工作温度： -40°C ~ 105°C
封装/外壳： 48-LQFP
包装： 托盘
产品目录页面： 734 (CN2011-ZH PDF)
Serial Peripheral Interface (SPI) Timing
56F8322 Technical Data, Rev. 16
Freescale Semiconductor
115
Preliminary
10.9 Serial Peripheral Interface (SPI) Timing
Table 10-18 SPI Timing1
1. Parameters listed are guaranteed by design.
Characteristic
Symbol
Min
Max
Unit
See Figure
Cycle time
Master
Slave
tC
50
—
ns
10-9, 10-10,
10-11, 10-12
Enable lead time
Master
Slave
tELD
—
25
—
ns
10-12
Enable lag time
Master
Slave
tELG
—
100
—
ns
10-12
Clock (SCK) high time
Master
Slave
tCH
17.6
25
—
ns
10-9, 10-10,
10-11, 10-12
Clock (SCK) low time
Master
Slave
tCL
16
16.67
—
ns
10-12
Data set up time required for inputs
Master
Slave
tDS
20
0
—
ns
10-9, 10-10,
10-11, 10-12
Data hold time required for inputs
Master
Slave
tDH
0
2
—
ns
10-9, 10-10,
10-11, 10-12
Access time (time to data active from high-impedance
state)
Slave
tA
4.8
15
ns
10-12
Disable time (hold time to high-impedance state)
Slave
tD
3.7
15.2
ns
10-12
Data Valid for outputs
Master
Slave (after enable edge)
tDV
—
4.5
20.4
ns
10-9, 10-10,
10-11, 10-12
Data invalid
Master
Slave
tDI
0
—
ns
10-9, 10-10,
10-11, 10-12
Rise time
Master
Slave
tR
—
11.5
10.0
ns
10-9, 10-10,
10-11, 10-12
Fall time
Master
Slave
tF
—
9.7
9.0
ns
10-9, 10-10,
10-11, 10-12
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