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参数资料
| 型号： | MC68CK338CPV14B1 |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, 14.4 MHz, MICROCONTROLLER, PQFP144 |
| 封装： | PLASTIC, TQFP-144 |
| 文件页数： | 21/133页 |
| 文件大小： | 944K |
| 代理商： | MC68CK338CPV14B1 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页当前第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页
MC68CK338
MOTOROLA
MC68CK338TS/D
117
27
Data In Valid to Clock Low (Data Setup)
tDICL
5—
ns
27A
Late BERR, HALT Asserted to Clock Low (Setup Time)
tBELCL
25
—
ns
28
AS, DS Negated to DSACK[1:0], BERR, HALT, AVEC Negated
tSNDN
0
100
ns
29
DS, CS Negated to Data In Invalid (Data In Hold)5
tSNDI
0—
ns
29A
DS, CS Negated to Data In High Impedance5, 6
tSHDI
—65
ns
30
CLKOUT Low to Data In Invalid (Fast Cycle Hold)5
tCLDI
19
—
ns
30A
CLKOUT Low to Data In High Impedance5
tCLDH
—
100
ns
31
DSACK[1:0] Asserted to Data In Valid7
tDADI
—58
ns
33
Clock Low to BG Asserted/Negated
tCLBAN
—35
ns
35
BR Asserted to BG Asserted (RMC Not Asserted)8
tBRAGA
1—
tcyc
37
BGACK Asserted to BG Negated
tGAGN
12
tcyc
39
BG Width Negated
tGH
2—
tcyc
39A
BG Width Asserted
tGA
1—
tcyc
46
R/W Width Asserted (Write or Read)
tRWA
174
—
ns
46A
R/W Width Asserted (Fast Write or Read Cycle)
tRWAS
104
—
ns
47A
Asynchronous Input Setup Time
BR, BGACK, DSACK[1:0], BERR, AVEC, HALT
tAIST
10
—
ns
47B
Asynchronous Input Hold Time
tAIHT
19
—
ns
48
DSACK[1:0] Asserted to BERR, HALT Asserted9
tDABA
—35
ns
53
Data Out Hold from Clock High
tDOCH
0—
ns
54
Clock High to Data Out High Impedance
tCHDH
—35
ns
55
R/W Asserted to Data Bus Impedance Change
tRADC
55
—
ns
56
RESET Pulse Width (Reset Instruction)
tHRPW
512
—
tcyc
57
BERR Negated to HALT Negated (Rerun)
tBNHN
0—
ns
70
Clock Low to Data Bus Driven (Show Cycle)
tSCLDD
035
ns
71
Data Setup Time to Clock Low (Show Cycle)
tSCLDS
19
—
ns
72
Data Hold from Clock Low (Show Cycle)
tSCLDH
10
—
ns
73
BKPT Input Setup Time
tBKST
19
—
ns
74
BKPT Input Hold Time
tBKHT
13
—
ns
75
Mode Select Setup Time (DATA[15:0], MODCLK, BKPT)tMSS
20
—
tcyc
76
Mode Select Hold Time (DATA[15:0], MODCLK, BKPT)
tMSH
0—
ns
77
RESET Assertion Time10
tRSTA
4—
tcyc
78
RESET Rise Time11, 12
tRSTR
—10
tcyc
Table 71 AC Timing (Continued)
(V
DD
and V
DDSYN
= 2.7 to 3.6 Vdc, V
SS
= 0 Vdc, T
A
= T
L
to T
H)
1
Num
Characteristic
Symbol
Min
Max
Unit
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
相关PDF资料 |
PDF描述 |
|---|---|
| MC68CK338CPV14 | 32-BIT, 14.4 MHz, MICROCONTROLLER, PQFP144 |
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| MC68F333FC | 32-BIT, FLASH, 16.78 MHz, MICROCONTROLLER, PQFP160 |
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相关代理商/技术参数 |
参数描述 |
|---|---|
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