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参数资料
| 型号： | MC68HC11E20VFN2 |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, MROM, 2 MHz, MICROCONTROLLER, PQCC52 |
| 封装： | PLASTIC, LCC-52 |
| 文件页数： | 25/242页 |
| 文件大小： | 1672K |
| 代理商： | MC68HC11E20VFN2 |
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Serial Peripheral Interface (SPI)
M68HC11E Family Data Sheet, Rev. 5.1
120
Freescale Semiconductor
Figure 8-1. SPI Block Diagram
8.4 Clock Phase and Polarity Controls
Software can select one of four combinations of serial clock phase and polarity using two bits in the SPI
control register (SPCR). The clock polarity is specified by the CPOL control bit, which selects an active
high or active low clock, and has no significant effect on the transfer format. The clock phase (CPHA)
control bit selects one of two different transfer formats. The clock phase and polarity should be identical
for the master SPI device and the communicating slave device. In some cases, the phase and polarity
are changed between transfers to allow a master device to communicate with peripheral slaves having
different requirements.
When CPHA equals 0, the SS line must be negated and reasserted between each successive serial byte.
Also, if the slave writes data to the SPI data register (SPDR) while SS is low, a write collision error results.
When CPHA equals 1, the SS line can remain low between successive transfers.
8--BIT SHIFT REGISTER
READ DATA BUFFER
MSB
LSB
MISO
PD2
MOSI
PD3
SCK
PD4
SS
PD5
DIVIDER
÷2 ÷4 ÷16 ÷32
INTERNAL
MCU CLOCK
SELECT
S
M
S
M
PIN
CONTROL
LOGIC
CLOCK
LOGIC
CLOCK
SPIF
SPE
DWOM
INST
R
CPOL
CPHA
SPRI
SPRO
SPI CONTROL REGISTER
MST
D
SE
C
DWOM
SPRI
SP
R
O
MSTR
SPE
SPI CONTROL
SPIF
WC
O
L
MODE
SPI STATUS REGISTER
SPI INTERRUPT
REQUEST
INTERNAL
DATA BUS
相关PDF资料 |
PDF描述 |
|---|---|
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| MC68S711E9CFN2 | 8-BIT, OTPROM, 2 MHz, MICROCONTROLLER, PQCC52 |
| MC68HC11E9MPB2 | 8-BIT, MROM, 2 MHz, MICROCONTROLLER, PQFP52 |
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相关代理商/技术参数 |
参数描述 |
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| MC68HC11E9BCB3 | 制造商:MOTOROLA 制造商全称:Motorola, Inc 功能描述:8-channel, 8-bit analog-to-digital (A/D) converter |
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