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参数资料
| 型号： | MC68HC11E20VFN2 |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, MROM, 2 MHz, MICROCONTROLLER, PQCC52 |
| 封装： | PLASTIC, LCC-52 |
| 文件页数： | 81/242页 |
| 文件大小： | 1672K |
| 代理商： | MC68HC11E20VFN2 |
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Serial Peripheral Interface Timing Characteristics
M68HC11E Family Data Sheet, Rev. 5.1
Freescale Semiconductor
171
10.17 Serial Peripheral Interface Timing Characteristics
Num
Characteristic(1)
1. VDD = 5.0 Vdc ±10%, VSS = 0 Vdc, TA = TL to TH, all timing is shown with respect to 20% VDD and 70% VDD, unless other-
wise noted
Symbol
E9
E20
Unit
Min
Max
Min
Max
Frequency of operation
E clock
fo
dc
3.0
dc
3.0
MHz
E-clock period
tCYC
333
—
333
—
ns
Operating frequency
Master
Slave
fop(m)
fop(s)
fo/32
dc
fo/2
fo
fo/128
dc
fo/2
fo
MHz
1
Cycle time
Master
Slave
tCYC(m)
tCYC(s)
2
1
32
—
2
1
128
—
tCYC
2
Enable lead time(2)
Slave
2. Time to data active from high-impedance state
tlead(s)
1—1
—
tCYC
3
Enable lag time(2)
Slave
tlag(s)
1—1
—
tCYC
4
Clock (SCK) high time
Master
Slave
tw(SCKH)m
tw(SCKH)s
tCYC–25
1/2
tCYC–25
16 tCYC
—
tCYC–25
1/2
tCYC–25
64 tCYC
—
ns
5
Clock (SCK) low time
Master
Slave
tw(SCKL)m
tw(SCKL)s
tCYC–25
1/2
tCYC–25
16 tCYC
—
tCYC–25
1/2
tCYC–25
64 tCYC
—
ns
6
Data setup time (inputs)
Master
Slave
tsu(m)
tsu(s)
30
—
30
—
ns
7
Data hold time (inputs)
Master
Slave
th(m)
th(s)
30
—
30
—
ns
8
Slave access time
CPHA = 0
CPHA = 1
ta
0
40
0
40
ns
9
Disable time (hold time
to high-impedance state)
Slave
tdis
—50—50
ns
10
Data valid(3) (after enable edge)
3. Assumes 200 pF load on SCK, MOSI, and MISO pins
tv
—50—50
ns
11
Data hold time (outputs)
(after enable edge)
tho
0—0
—
ns
相关PDF资料 |
PDF描述 |
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