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参数资料
| 型号： | MC68HC908RK2DW |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, FLASH, 4 MHz, MICROCONTROLLER, PDSO20 |
| 封装： | PLASTIC, SOIC-20 |
| 文件页数： | 135/158页 |
| 文件大小： | 1020K |
| 代理商： | MC68HC908RK2DW |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页当前第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页
Internal Clock Generator Module (ICG)
MC68HC908RK2 Data Sheet, Rev. 5.1
78
Freescale Semiconductor
6.7 I/O Registers
The ICG contains five registers, summarized in Figure 6-11. These registers are:
ICG control register, ICGCR
ICG multiplier register, ICGMR
ICG trim register, ICGTR
ICG DCO divider control register, ICGDVR
ICG DCO stage control register, ICGDSR
Several of the bits in these registers have interaction where the state of one bit may force another bit to
a particular state or prevent another bit from being set or cleared. A summary of this interaction is shown
in Table 6-5.
Addr.
Register Name
Bit 7
654321
Bit 0
$0036
Internal Clock Generator
Control Register (ICGCR)
Read:
CMIE
CMF
CMON
CS
ICGON
ICGS
ECGON
ECGS
Write:
Reset:
00001000
$0037
Internal Clock Generator
Multiplier Register (ICGMR)
Read:
R
N6N5
N4N3N2N1N0
Write:
Reset:
00010101
$0038
Internal Clock Generator
Trim Register (ICGTR)
Read:
TRIM7
TRIM6
TRIM5
TRIM4
TRIM3
TRIM2
TRIM1
TRIM0
Write:
Reset:
10000000
$0039
ICG DCO Divider Control
Register (ICGDVR)
Read:
RRRR
DDIV3
DDIV2
DDIV1
DDIV0
Write:
Reset:
0000
UUUU
$003A
ICG DCO Stage Register
(ICGDSR)
Read:
DSTG7
DSTG6
DSTG5
DSTG4
DSTG3
DSTG2
DSTG1
DSTG0
Write:
Reset:
Unaffected by reset
= Unimplemented
R
= Reserved
U = Unaffected
Figure 6-11. ICG I/O Register Summary
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PDF描述 |
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