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参数资料
| 型号： | MPC8541ECPXAKF |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, 600 MHz, RISC PROCESSOR, PBGA783 |
| 封装： | 29 X 29 MM, 3.75 MM HEIGHT, 1 MM PITCH, FLIP CHIP, PLASTIC, BGA-783 |
| 文件页数： | 41/88页 |
| 文件大小： | 1221K |
| 代理商： | MPC8541ECPXAKF |
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MPC8541E PowerQUICC III Integrated Communications Processor Hardware Specification, Rev. 3.2
46
Freescale Semiconductor
JTAG
11 JTAG
This section describes the AC electrical specifications for the IEEE 1149.1 (JTAG) interface of the
MPC8541E.
Low period of SCL
tSCLCH
4.7
-
μs
High period of SCL
tSCHCL
4-
μs
Start condition setup time
tSCHDL
2-
μs
Start condition hold time
tSDLCL
3-
μs
Data hold time
tSCLDX
2-
μs
Data setup time
tSDVCH
3-
μs
SDA/SCL rise time
tSRISE
-1
μs
SDA/SCL fall time (master)
tSFALL
-
303
ns
Stop condition setup time
tSCHDH
2-
μs
Table 37. CPM I2C Timing (fSCL=400KHz)
Characteristic
Expression
Frequency = 400KHz
Unit
Min
Max
SCL clock frequency (slave)
fSCL
400
KHz
SCL clock frequency (master)
fSCL
-400
KHz
Bus free time between transmissions
tSDHDL
1.2
-
μs
Low period of SCL
tSCLCH
1.2
-
μs
High period of SCL
tSCHCL
1-
μs
Start condition setup time
tSCHDL
420
-
ns
Start condition hold time
tSDLCL
630
-
ns
Data hold time
tSCLDX
420
-
ns
Data setup time
tSDVCH
630
-
ns
SDA/SCL rise time
tSRISE
-250
ns
SDA/SCL fall time
tSFALL
-75
ns
Stop condition setup time
tSCHDH
420
-
ns
Table 38. JTAG AC Timing Specifications (Independent of SYSCLK) 1
At recommended operating conditions (see Table 2).
Parameter
Symbol 2
Min
Max
Unit
Notes
JTAG external clock frequency of operation
fJTG
0
33.3
MHz
JTAG external clock cycle time
t JTG
30
—
ns
JTAG external clock pulse width measured at 1.4 V
tJTKHKL
15
—
ns
JTAG external clock rise and fall times
tJTGR & tJTGF
02
ns
Table 36. CPM I2C Timing (fSCL=100KHz) (continued)
Characteristic
Expression
Frequency = 100KHz
Unit
Min
Max
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PDF描述 |
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