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参数资料
| 型号： | NCN6004AFTBR2G |
| 厂商： | ON Semiconductor |
| 文件页数： | 21/40页 |
| 文件大小： | 0K |
| 描述： | IC INTERFACE SAM/SIM DUAL 48TQFP |
| 标准包装： | 1 |
| 应用： | PC，PDA |
| 接口： | 微控制器 |
| 电源电压： | 1.8 V ~ 5.5 V |
| 封装/外壳： | 48-TQFP 裸露焊盘 |
| 供应商设备封装： | 48-TQFP（7x7） |
| 包装： | 标准包装 |
| 安装类型： | 表面贴装 |
| 其它名称： | NCN6004AFTBR2GOSDKR |
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NCN6004A
http://onsemi.com
28
CRD_CLK
CLOCK_IN
CLOCK : 2
CLOCK : 4
CLOCK : 8
A0
A1
A2
A3
Clock is updated upon CLOCK :8 rising edge
These
bits
program
Internal
CLOCK
divider
CLOCK programming is activated
by the PGM rising edge.
CLOCK
=
1:1
ratio
CARD_SEL
Figure 25. Clock Programming Timings
CS
PGM
The example given in Figure 25 highlights the delay
coming
from
the
internal
clock
duty
cycle
resynchronization. Since the clock signal is asynchronous,
it is up to the programmer to make sure the next card
transaction is not activated before, respectively, either the
CRD_CLK_A or CRD_CLK_B signal has been updated.
Generally speaking, such a delay can be derived from the
maximum
clock
frequency
provided
to
the
interface.
Figure 26. Card Clock 1/2 Divider Operation
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PDF描述 |
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参数描述 |
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