参数资料
| 型号： | PCF8562TT/S400/2,1 |
| 厂商： | NXP Semiconductors |
| 文件页数： | 31/43页 |
| 文件大小： | 0K |
| 描述： | IC LCD DRIVER 48-TSSOP |
| 标准包装： | 2,000 |
| 显示器类型： | LCD |
| 配置： | 7段 + DP，14段 + DP + AP，点阵 |
| 接口： | I²C，2 线串口 |
| 数字或字符： | 8 个字符，16 个字符 |
| 电流 - 电源： | 8µA |
| 电源电压： | 1.8 V ~ 5.5 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 48-TFSOP（0.240"，6.10mm 宽） |
| 供应商设备封装： | 48-TSSOP |
| 包装： | 带卷 (TR) |
| 其它名称： | PCF8562TTS40021 |
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NXP Semiconductors
PCF8562
Universal LCD driver for low multiplex rates
11. Static characteristics
Table 17. Static characteristics
V DD = 1.8 V to 5.5 V; V SS = 0 V; V LCD = 2.5 V to 6.5 V; T amb = ? 40 ? C to +85 ? C; unless otherwise specified.
Symbol
Parameter
Conditions
Min
Typ
Max
Unit
Supplies
V DD
supply voltage
1.8
-
5.5
V
V LCD
LCD supply voltage
2.5
-
6.5
V
I DD
I DD(LCD)
supply current
LCD supply current
f clk(ext) = 1536 Hz
f clk(ext) = 1536 Hz
-
-
8
24
20
60
? A
? A
Logic [3]
V P(POR)
power-on reset supply voltage
1.0
1.3
1.6
V
V IL
LOW-level input voltage
on pins CLK, SYNC,
V SS
-
0.3V DD
V
OSC, A0 to A2, SA0,
SCL, SDA
V IH
HIGH-level input voltage
on pins CLK, SYNC,
[4][5]
0.7V DD
-
V DD
V
OSC, A0 to A2, SA0,
SCL, SDA
I OL
LOW-level output current
output sink current;
V OL = 0.4 V; V DD = 5 V
on pins CLK and SYNC
on pin SDA
1
3
-
-
-
-
mA
mA
I OH(CLK)
HIGH-level output current on pin CLK
output source current;
1
-
-
mA
V OH = 4.6 V; V DD = 5 V
I L
leakage current
V I = V DD or V SS ;
? 1
-
+1
? A
on pins CLK, SCL, SDA,
A0 to A2 and SA0
I L(OSC)
C I
leakage current on pin OSC
input capacitance
V I = V DD
? 1
-
-
-
+1
7
? A
pF
LCD outputs
? V O
output voltage variation
on pins BP0 to BP3 and
? 100
-
+100
mV
S0 to S31
R O
output resistance
V LCD = 5 V
on pins BP0 to BP3
on pins S0 to S31
-
-
1.5
6.0
-
-
k ?
k ?
[1]
[2]
[3]
[4]
[5]
[6]
[7]
V LCD > 3 V for 1 ? 3 bias.
LCD outputs are open-circuit; inputs at V SS or V DD ; external clock with 50 % duty factor; I 2 C-bus inactive.
The I 2 C-bus interface of PCF8562 is 5 V tolerant.
When tested, I 2 C pins SCL and SDA have no diode to V DD and may be driven to the V I limiting values given in Table 16 (see Figure 19
as well).
Propagation delay of driver between clock (CLK) and LCD driving signals.
Periodically sampled, not 100 % tested.
Outputs measured one at a time.
PCF8562
Product data sheet
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Rev. 6 — 16 June 2011
? NXP B.V. 2011. All rights reserved.
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