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参数资料
| 型号： | PCF8890 |
| 英文描述： | 240 + 1 outputs TFT LCD gate driver |
| 中文描述： | 240 1输出TFT液晶栅极驱动器 |
| 文件页数： | 24/76页 |
| 文件大小： | 385K |
| 代理商： | PCF8890 |
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2002 Aug 16
24
Philips Semiconductors
Preliminary specification
STN RGB - 384 output column driver
PCF8832
Table 7
Explanation of control bits used in Table 6
17
18
19
1A
0
0
0
0
FI
IR
0
FRCM
VPR0
VPC0
SLA0
0D
A2
05
07
frame inversion; FRC
program V
HREG
program V
COL
temperature
compensation slopes
temperature
compensation slopes
VOP
VH
limit value
row driver control
chip identity
temperature read data
software reset
VPR7
0
0
VPR6
0
0
VPR5
0
SLB2
VPR4
0
SLB1
VPR3
VPC3
SLB0
VPR2
VPC2
SLA2
VPR1
VPC1
SLA1
1B
0
0
SLD2
SLD1
SLD0
SLC2
SLC1
SLC0
10
1C
1D
1E
1F
3F
VL7
0
0
0
0
VL6
0
0
TD6
0
VL5
0
0
TD5
1
VL4
DBL
0
TD4
1
VL3
SEC
0
TD3
1
VL2
R1F
ID2
TD2
1
VL1
SW2
ID1
TD1
1
VL0
SW1
ID0
TD0
1
D1
04
00
20
BIT
0
1
PD
RSTA
MX
MY
L
V
DON
DIM
PM
SPS
EC
ER
OFQ
VMOE
VCOE
IR
FI
FRCM
active mode
no register read
no mirror X
no mirror Y
portrait mode
RAM write in X direction
display off
normal display
no partial display mode
scroll inactive
internal oscillator
external resistor used
f
LCK
= 300 kHz
V
M
is input
V
COL
is input
asynchronous n-line inversion
no frame inversion
frame rate control, 7-frame method
Power-down mode
read value from select address
mirror X
mirror Y
landscape mode
vertical RAM write, in Y direction
display on
display inverse video mode
partial display mode active
start programmed scroll active
external clock applied
internal resistor used
oscillator frequency at LCK output f
LCK
= 600 kHz
V
M
is enabled as output
V
COL
is enabled as output
n-line inversion related to frame
frame inversion active
frame rate control, 9-frame method
Row driver control
DBL
SEC
R1F
SW1
SW2
single line mode
first half of RAM is displayed (DBL = 1)
shift register 2 first in chain
normal row shift direction REG1[0 to 79]
normal row shift direction REG2[80 to 159]
double line mode
second half of RAM is displayed (DBL = 1)
shift register 1 first in chain
swapped shift direction REG1[79 to 0]
swapped shift direction REG2[159 to 80]
ADR
(HEX)
D7
D6
D5
D4
D3
D2
D1
D0
DEFAULT
(HEX)
DESCRIPTION
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