参数资料
型号: S1D13505F00A100
元件分类: 显示控制器
英文描述: CRT OR FLAT PNL GRPH DSPL CTLR, PQFP128
封装: QFP15-128
文件页数: 51/192页
文件大小: 3311K
代理商: S1D13505F00A100
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5: PINS
S1D13505F00A HARDWARE FUNCTIONAL
EPSON
1-13
SPECIFICATION (X23A-A-001-12)
Host Interface
Table 5-1 Host Interface Pin Descriptions
Pin Name
Type
Pin #
Driver
Reset#
State
Description
AB0
I
3
CS
Hi-Z
For SH-3/SH-4 Bus, this pin inputs system address bit 0 (A0).
For MC68K Bus 1, this pin inputs the lower data strobe (LDS#).
For MC68K Bus 2, this pin inputs system address bit 0 (A0).
For Generic Bus, this pin inputs system address bit 0 (A0).
For MIPS/ISA Bus, this pin inputs system address bit 0 (SA0).
For Philips PR31500/31700 Bus, this pin inputs system address bit 0
(A0).
For Toshiba TX3912 Bus, this pin inputs system address bit 0 (A0).
For PowerPC Bus, this pin inputs system address bit 31 (A31).
For PC Card (PCMCIA) Bus, this pin inputs system address bit 0 (A0).
See “Table 5-7 CPU Interface Pin Mapping” for summary. See the respec-
tive AC Timing diagram for detailed functionality.
AB[12:1]
I
119–128,
1, 2
C
Hi-Z
For PowerPC Bus, these pins input the system address bits 19 through
30 (A[19:30]).
For all other busses, these pins input the system address bits 12 through
1 (A[12:1]).
See “Table 5-7 CPU Interface Pin Mapping” for summary. See the respec-
tive AC Timing diagram for detailed functionality.
AB[16:13]
I
115-118
C
Hi-Z
For Philips PR31500/31700 Bus, these pins are connected to VDD.
For Toshiba TX3912 Bus, these pins are connected to VDD.
For PowerPC Bus, these pins input the system address bits 15 through
18 (A[15:18]).
For all other busses, these pins input the system address bits 16 through
13 (A[16:13]).
See “Table 5-7 CPU Interface Pin Mapping” for summary. See the respec-
tive AC Timing diagram for detailed functionality.
AB17#
I
114
C
Hi-Z
For Philips PR31500/31700 Bus, this pin inputs the I/O write command
(/CARDIOWR).
For Toshiba TX3912 Bus, this pin inputs the I/O write command (CAR-
DIOWR*).
For PowerPC Bus, this pin inputs the system address bit 14 (A14).
For all other busses, this pin inputs the system address bit 17 (A17).
See “Table 5-7 CPU Interface Pin Mapping” for summary. See the respec-
tive AC Timing diagram for detailed functionality.
AB18
I
113
C
Hi-Z
For Philips PR31500/31700 Bus, this pin inputs the I/O read command (/
CARDIORD).
For Toshiba TX3912 Bus, this pin inputs the I/O read command (CAR-
DIORD*).
For PowerPC Bus, this pin inputs the system address bit 13 (A13).
For all other busses, this pin inputs the system address bit 18 (A18).
See “Table 5-7 CPU Interface Pin Mapping” for summary. See the respec-
tive AC Timing diagram for detailed functionality.
AB19
I
112
C
Hi-Z
For Philips PR31500/31700 Bus, this pin inputs the card control register
access (/CARDREG).
For Toshiba TX3912 Bus, this pin inputs the card control register (CAR-
DREG*).
For PowerPC Bus, this pin inputs the system address bit 12 (A12).
For all other busses, this pin inputs the system address bit 19 (A19).
See “Table 5-7 CPU Interface Pin Mapping” for summary. See the respec-
tive AC Timing diagram for detailed functionality.
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PDF描述
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