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参数资料
| 型号： | S1D13505F00A100 |
| 元件分类： | 显示控制器 |
| 英文描述： | CRT OR FLAT PNL GRPH DSPL CTLR, PQFP128 |
| 封装： | QFP15-128 |
| 文件页数： | 7/192页 |
| 文件大小： | 3311K |
| 代理商： | S1D13505F00A100 |
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2: FEATURES
S1D13505F00A HARDWARE FUNCTIONAL
EPSON
1-3
SPECIFICATION (X23A-A-001-12)
2.4 Display Modes
1/2/4/8/15/16 bit-per-pixel (bpp) support on LCD/CRT.
Up to 16 shades of gray using FRM on monochrome passive LCD panels.
Up to 4096 colors on passive LCD panels; three 256x4 Look-Up Tables (LUT) are used to map 1/
2/4/8 bpp modes into these colors, 15/16 bpp modes are mapped directly using the 4 most signi-
cant bits of the red, green and blue colors.
Up to 64K colors on TFT/D-TFD LCD panels and CRT; three 256x4 Look-Up Tables are used to
map 1/2/4/8 bpp modes into 4096 colors, 15/16 bpp modes are mapped directly.
2.5 Display Features
SwivelViewTM: direct hardware 90 rotation of display image for “portrait” mode display.
Split Screen Display: allows two different images to be simultaneously viewed on the same dis-
play.
Virtual Display Support: displays images larger than the display size through the use of panning.
Double Buffering/multi-pages: provides smooth animation and instantaneous screen update.
Acceleration of screen updates by allocating full display memory bandwidth to CPU (see
REG[23h] bit 7).
Hardware 64x64 pixel 2-bit cursor or full screen 2-bit ink layer.
Simultaneous display of CRT and passive panel or TFT/D-TFD panel.
Normal mode for cases where LCD and CRT screen sizes are identical.
Line-doubling for simultaneous display of 240-line images on 240-line LCD and 480-line CRT.
Even-scan or interlace modes for simultaneous display of 480-line images on 240-line LCD and
480-line CRT.
2.6 Clock Source
Single clock input for both the pixel and memory clocks.
Memory clock can be input clock or (input clock/2), providing exibility to use CPU bus clock as
input.
Pixel clock can be the memory clock, (memory clock/2), (memory clock/3) or (memory clock/4).
2.7 Miscellaneous
The memory data bus, MD[15:0], is used to congure the chip at power-on.
Three General Purpose Input/Output pins, GPIO[3:1], are available if the upper Memory Address
pins are not required for asymmetric DRAM support.
Suspend power save mode can be initiated by either hardware or software.
The SUSPEND# pin is used either as an input to initiate Suspend mode, or as a General Purpose
Output that can be used to control the LCD backlight. Power-on polarity is selected by an MD
conguration pin.
Operating voltages from 2.7 volts to 5.5 volts are supported
128-pin QFP15 surface mount package
相关PDF资料 |
PDF描述 |
|---|---|
| S1S60000F00A100 | 1 CHANNEL(S), 2M bps, LOCAL AREA NETWORK CONTROLLER, PQFP100 |
| S202T01 | TRIGGER OUTPUT SOLID STATE RELAY, 3000 V ISOLATION-MAX |
| S102T01 | TRIGGER OUTPUT SOLID STATE RELAY, 3000 V ISOLATION-MAX |
| S3C4510BXX-QE | 32-BIT, 50 MHz, RISC MICROCONTROLLER, PQFP208 |
| S3C72E8XX-QX | 4-BIT, MROM, 6 MHz, MICROCONTROLLER, PQFP100 |
相关代理商/技术参数 |
参数描述 |
|---|---|
| S1D13505F00A200 | 功能描述:LCD 驱动器 LCD Controllers RoHS:否 制造商:Maxim Integrated 数位数量:4.5 片段数量:30 最大时钟频率:19 KHz 工作电源电压:3 V to 3.6 V 最大工作温度:+ 85 C 最小工作温度:- 20 C 封装 / 箱体:PDIP-40 封装:Tube |
| S1D13506 | 制造商:EPSON 制造商全称:EPSON 功能描述:S1D13506 Color LCD/CRT/TV Controller |
| S1D13506F00A | 制造商:EPSON 制造商全称:EPSON 功能描述:LCD Controller ICs |
| S1D13506F00A100 | 制造商:Epson Electronics America Inc 功能描述:LCD DRVR 3V/3.3V/5V 80-Pin TQFP |
| S1D13506F00A200 | 功能描述:显示驱动器和控制器 (SVGA) 800x600 LCD Controller RoHS:否 制造商:Panasonic Electronic Components 工作电源电压:2.7 V to 5.5 V 最大工作温度: 安装风格:SMD/SMT 封装 / 箱体:QFN-44 封装:Reel |
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