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参数资料
| 型号： | S1D13806F00A |
| 元件分类： | 显示控制器 |
| 英文描述： | CRT OR FLAT PNL GRPH DSPL CTLR, PQFP144 |
| 封装： | QFP-144 |
| 文件页数： | 135/352页 |
| 文件大小： | 3748K |
| 代理商： | S1D13806F00A |
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4: PINS
1-10
EPSON
S1D13806 SERIES HARDWARE FUNCTIONAL
SPECIFICATION (X28B-A-001-03)
4.2.1 Host Interface
Table 4-1 Host Interface Pin Descriptions
Pin Name Type
Pin #
Cell
RESET#
State
Description
AB0
I
26
CS
Hi-Z
For SH-3/SH-4 Bus, this pin inputs system address bit 0 (A0).
For MC68K Bus 1, this pin inputs the lower data strobe (LDS#).
For MC68K Bus 2, this pin inputs system address bit 0 (A0).
For Generic Bus, this pin inputs system address bit 0 (A0).
For MIPS/ISA Bus, this pin inputs system address bit 0 (SA0).
For Philips PR31500/31700 Bus, this pin inputs system address bit 0 (A0).
For Toshiba TX39xx Bus, this pin inputs system address bit 0 (A0).
For PowerPC Bus, this pin inputs system address bit 31 (A31).
For PC Card (PCMCIA) Bus, this pin inputs system address bit 0 (A0).
See Table 4-9, “CPU Interface Pin Mapping,” on page 18 for summary.
See the respective AC Timing diagram for detailed functionality.
AB[12:1]
I
14-25
C
Hi-Z
For PowerPC Bus, these pins input the system address bits 19 through 30
(A[19:30]).
For all other busses, these pins input the system address bits 12 through 1
(A[12:1]).
See Table 4-9, “CPU Interface Pin Mapping,” on page 18 for summary.
See the respective AC Timing diagram for detailed functionality.
AB[16:13]
I
10-13
C
Hi-Z
For Philips PR31500/31700 Bus, these pins are connected to VDD.
For Toshiba TX39xx Bus, these pins are connected to VDD.
For PowerPC Bus, these pins input the system address bits 15 through 18
(A[15:18]).
For all other busses, these pins input the system address bits 16 through 13
(A[16:13]).
See Table 4-9, “CPU Interface Pin Mapping,” on page 18 for summary.
See the respective AC Timing diagram for detailed functionality.
AB17
I
9
C
Hi-Z
For Philips PR31500/31700 Bus, this pin inputs the IO write command (/CAR-
DIOWR).
For Toshiba TX39xx Bus, this pin inputs the IO write command (CARDIOWR*).
For PowerPC Bus, this pin inputs the system address bit 14 (A14).
For all other busses, this pin inputs the system address bit 17 (A17).
See Table 4-9, “CPU Interface Pin Mapping,” on page 18 for summary.
See the respective AC Timing diagram for detailed functionality.
AB18
I
8
C
Hi-Z
For Philips PR31500/31700 Bus, this pin inputs the IO read command (/CAR-
DIORD).
For Toshiba TX39xx Bus, this pin inputs the IO read command (CARDIORD*).
For PowerPC Bus, this pin inputs the system address bit 13 (A13).
For all other busses, this pin inputs the system address bit 18 (A18).
See Table 4-9, “CPU Interface Pin Mapping,” on page 18 for summary.
See the respective AC Timing diagram for detailed functionality.
AB19
I
7
C
Hi-Z
For Philips PR31500/31700 Bus, this pin inputs the card control register access
(/CARDREG).
For Toshiba TX39xx Bus, this pin inputs the card control register access (CAR-
DREG*).
For PowerPC Bus, this pin inputs the system address bit 12 (A12).
For all other busses, this pin inputs the system address bit 19 (A19).
See Table 4-9, “CPU Interface Pin Mapping,” on page 18 for summary.
See the respective AC Timing diagram for detailed functionality.
AB20
I
6
C
Hi-Z
For the MIPS/ISA Bus, this pin inputs system address bit 20. Note that for the ISA
Bus, the unlatched LA20 must first be latched before input to AB20.
For Philips PR31500/31700 Bus, this pin inputs the address latch enable (ALE).
For Toshiba TX39xx Bus, this pin inputs the address latch enable (ALE).
For PowerPC Bus, this pin inputs the system address bit 11 (A11).
For all other busses, this pin inputs the system address bit 20 (A20).
See Table 4-9, “CPU Interface Pin Mapping,” on page 18 for summary.
See the respective AC Timing diagram for detailed functionality.
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PDF描述 |
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