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参数资料
| 型号： | S1D13806F00A |
| 元件分类： | 显示控制器 |
| 英文描述： | CRT OR FLAT PNL GRPH DSPL CTLR, PQFP144 |
| 封装： | QFP-144 |
| 文件页数： | 176/352页 |
| 文件大小： | 3748K |
| 代理商： | S1D13806F00A |
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10: 2D BITBLT ENGINE
S1D13806 SERIES PROGRAMMING NOTES
EPSON
2-57
AND EXAMPLES (X28B-G-003-01)
10.2 BitBLT Descriptions
The S1D13806 supports 13 fundamental BitBLT operations:
Write BitBLT with ROP.
Read BitBLT.
Move BitBLT in positive direction with ROP.
Move BitBLT in negative direction with ROP.
Transparent Write BitBLT.
Transparent Move BitBLT in positive direction.
Pattern Fill with ROP.
Pattern Fill with Transparency.
Color Expansion.
Color Expansion with Transparency.
Move BitBLT with Color Expansion.
Move BitBLT with Color Expansion and Transparency.
Solid Fill.
Most of the 13 operations are self completing. This means once they begin they complete on their
own, not requiring data transfers with the CPU. The remaining five BitBLT operations (Write Bit-
BLT with ROP, Transparent Write BitBLT, Color Expansion, Color Expansion with Transparency,
Read BitBLT) require data to be written/read to/from the display buffer. This data must be trans-
ferred one word (16-bits) at a time. This does not imply only 16-bit CPU instructions are acceptable.
If a system is able to separate one DWORD write into two WORD writes and the CPU writes the
low word before the high word, then 32-bit CPU instructions are acceptable. Otherwise, 16-bit CPU
instructions are required.
The data is not directly written/read to/from the display buffer. It is written/read to/from the BitBLT
FIFO through the 1M BitBLT aperture specified at the address of REG[100000h]. The 16 word
FIFO can be written to only when not full and can be read from only when not empty. Failing to
monitor the FIFO status can result in a BitBLT FIFO overflow or underflow.
While the FIFO is being written to by the CPU, it is also being emptied by the S1D13806. If the
S1D13806 empties the FIFO faster than the CPU can fill it, it may not be possible to cause an over-
flow/underflow. In these cases, performance can be improved by not monitoring the FIFO status.
However, this is very much platform dependent and must be determined for each system.
Note: When TV with flicker filter is enabled or simultaneous display is active, always test the FIFO status
before reading from/writing to the FIFO.
相关PDF资料 |
PDF描述 |
|---|---|
| S1D13A05B00B | 320 X 320 PIXELS CRT OR FLAT PNL GRPH DSPL CTLR, PBGA121 |
| S1D13A05F00A100 | 320 X 320 PIXELS CRT OR FLAT PNL GRPH DSPL CTLR, PBGA121 |
| S1R72005F00A300 | UNIVERSAL SERIAL BUS CONTROLLER, PQFP64 |
| S1R72105F00A000 | SCSI BUS CONTROLLER, PQFP100 |
| S1R72803F00A100 | 1 CHANNEL(S), 400M bps, SERIAL COMM CONTROLLER, PQFP100 |
相关代理商/技术参数 |
参数描述 |
|---|---|
| S1D13806F00A100 | 制造商:Epson Electronics America Inc 功能描述: |
| S1D13A03B00B | 制造商:EPSON 制造商全称:EPSON 功能描述:LCD Controller ICs |
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| S1D13A03F00A | 制造商:EPSON 制造商全称:EPSON 功能描述:LCD Controller ICs |
| S1D13A04B00B | 制造商:EPSON 制造商全称:EPSON 功能描述:LCD Controller ICs |
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