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参数资料
| 型号： | SI4113M-EVB |
| 厂商： | Silicon Laboratories Inc |
| 文件页数： | 33/36页 |
| 文件大小： | 0K |
| 描述： | BOARD EVALUATION FOR SI4113 |
| 标准包装： | 1 |
| 类型： | 合成器 |
| 适用于相关产品： | SI4113 |
| 已供物品： | 板，CD |
| 其它名称： | 336-1100 |
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Si4133
6
Rev. 1.61
Figure 1. SCLK Timing Diagram
Table 4. Serial Interface Timing
(V
DD = 2.7 to 3.6 V, TA = –40 to 85 °C)
Parameter1
Symbol
Test Condition
Min
Typ
Max
Unit
SCLK Cycle Time
tclk
40
—
ns
SCLK Rise Time
tr
—
50
ns
SCLK Fall Time
t
f
—
50
ns
SCLK High Time
th
10
—
ns
SCLK Low Time
tl
10
—
ns
SDATA Setup Time to SCLK
2
t
su
5
—
ns
SDATA Hold Time from SCLK
2
thold
0
—
ns
SEN
to SCLKDelay Time2
ten1
10
—
ns
SCLK
to SENDelay Time2
t
en2
12
—
ns
SEN
to SCLKDelay Time2
ten3
12
—
ns
SEN Pulse Width
tw
10
—
ns
Notes:
1. All timing is referenced to the 50% level of the waveforms unless otherwise noted.
2. Timing is not referenced to 50% level of the waveform. See Figure 2.
SCLK
80%
20%
50%
t
r
t
f
t
l
t
clk
t
h
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参数描述 |
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