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参数资料
| 型号： | SI5368B-C-GQ |
| 厂商： | Silicon Laboratories Inc |
| 文件页数： | 32/92页 |
| 文件大小： | 0K |
| 描述： | IC CLK MULTIPLIER ATTEN 100TQFP |
| 标准包装： | 90 |
| 系列： | DSPLL® |
| 类型： | 时钟放大器，振动衰减器 |
| PLL： | 是 |
| 输入： | 时钟 |
| 输出： | CML，CMOS，LVDS，LVPECL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 4:5 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 808MHz |
| 除法器/乘法器： | 无/是 |
| 电源电压： | 1.71 V ~ 3.63 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 100-TQFP |
| 供应商设备封装： | 100-TQFP（14x14） |
| 包装： | 托盘 |
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Si5368
38
Rev. 1.0
Reset value = 0000 0001
Reset value = 0000 0000
2
FSYNC_
SKEW [16:0]
FSYNC_SKEW [16:0].
Phase skew control for FSYNCOUT. The resolution of the skew control is 1/fCKOUT2.
Entered values should be less than the FSYNCOUT period.
0 0000 0000 0000 0000=Zero phase skew.
0 0000 0000 0000 0001=Delay of 1 period of CLKOUT_2.
1 0010 1111 1011 1111=Delay of 77,759 periods of CKOUT2. If CKOUT2=622.08 MHz
and FSYNCOUT=8 kHz, this delay equals 125 ms - 1/fCKOUT2 and is the maximum
value that should be entered.
1 1111 1111 1111 1111=Delay of 131,071 periods of CKOUT2.
1:0
FSYNC_
PW [9:0]
FSYNC_PW [9:0].
These bits control the pulse width of the FSYNCOUT signal. The resolution of the pulse
width control is 1/fCKOUT2.
0000000000=50% duty cycle.
0000000001=1 period of CKOUT2.
0000000010=2 periods of CKOUT2.
1111111111=1023 periods of CKOUT2.
Register 13.
Bit
D7D6D5D4D3D2D1
D0
Name
FSYNC_PW [7:0]
Type
R/W
Bit
Name
Function
7:0
FSYNC_PW [7:0] FSYNC_PW [7:0].
See Register 12.
Register 14.
Bit
D7D6D5D4D3D2D1
D0
Name
FSYNC_SKEW [15:8]
Type
R/W
Bit
Name
Function
7:0
FSYNC_SKEW [15:8] FSYNC_SKEW [15:8].
See Register 12.
Bit
Name
Function
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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| Si5368C-B-GQ | 功能描述:锁相环 - PLL ANY-RATE CLK MULT JITTER ATTEN 5 OUTS RoHS:否 制造商:Silicon Labs 类型:PLL Clock Multiplier 电路数量:1 最大输入频率:710 MHz 最小输入频率:0.002 MHz 输出频率范围:0.002 MHz to 808 MHz 电源电压-最大:3.63 V 电源电压-最小:1.71 V 最大工作温度:+ 85 C 最小工作温度:- 40 C 封装 / 箱体:QFN-36 封装:Tray |
| SI5368C-B-GQR | 制造商:Silicon Laboratories Inc 功能描述: |
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