参数资料
| 型号： | SOUNDBITE |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 38/68页 |
| 文件大小： | 0K |
| 描述： | BOARD DEMO AUDIO DEVELOPMENT |
| 标准包装： | 1 |
| 系列： | Symphony™ soundBite |
| 主要目的： | 音频，音频处理 |
| 已用 IC / 零件： | DSPB56371 |
| 主要属性： | 最高 8 通道数字音频 |
| 次要属性： | USB、I2C、SPI 接口 |
| 已供物品： | 板，缆线，CD |
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Reset, Stop, Mode Select, and Interrupt Timing
Table 18. Clock Operation 150 and 181 MHz Values
150 MHz
181 MHz
No.
Characteristics
Symbol
Min
Max
Min
Max
6
EXTAL input high 1,2
Eth
3.33ns
100ns
2.75ns
100ns
(40% to 60% duty cycle)
7
EXTAL input low 1,2
Etl
3.33ns
100ns
2.75ns
100ns
(40% to 60% duty cycle)
8
EXTAL cycle time 2
Etc
9
? With PLL disabled
? With PLL enabled
Instruction cycle time= I CYC = T C3
? With PLL disabled
? With PLL enabled
Icyc
6.66ns
6.66ns
6.66ns
6.66ns
inf
200ns
inf
13.0ns
5.52ns
5.52ns
5.52ns
5.52ns
inf
200ns
inf
13.0ns
Note:
1.
2.
3.
4.
Measured at 50% of the input transition
The maximum value for PLL enabled is given for minimum V CO and maximum MF.
The maximum value for PLL enabled is given for minimum V CO and maximum DF.
The indicated duty cycle is for the specified maximum frequency for which a part is rated. The minimum clock high or low
time required for correct operation, however, remains the same at lower operating frequencies; therefore, when a lower
clock frequency is used, the signal symmetry may vary from the specified duty cycle as long as the minimum high time
and low time requirements are met.
11
Reset, Stop, Mode Select, and Interrupt Timing
Table 19. Reset, Stop, Mode Select, and Interrupt Timing
No.
10
Characteristics
Delay from RESET assertion to all output pins at
Expression
—
Min
—
Max
11
Unit
ns
reset value 3
11
Required RESET duration 4
? Power on, external clock generator, PLL
2 x T C
11.1
—
ns
disabled
? Power on, external clock generator, PLL
2 x T C
11.1
--
ns
enabled
12
Syn reset setup time from RESET
? Maximum
T C
—
5.5
ns
13
Syn reset de assert delay time
? Minimum
? Maximum(PLL enabled)
2 × T C
(2xT C )+T LOCK
11.1
5.0
—
ns
ms
14
15
Mode select setup time
Mode select hold time
10.0
10.0
—
—
ns
ns
16
Minimum edge-triggered interrupt request
2 xT C
11.1
—
ns
assertion width
17
Minimum edge-triggered interrupt request
2 xT C
11.1
—
ns
deassertion width
DSP56371 Data Sheet, Rev. 4.1
38
Freescale Semiconductor
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