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参数资料
型号： ST10F252M-4T3
厂商： STMICROELECTRONICS
元件分类： 微控制器/微处理器
英文描述： 16-BIT, FLASH, 40 MHz, RISC MICROCONTROLLER, PQFP100
封装： 14 X 14 MM, 1.40 MM HEIGHT, 0.50 MM PITCH, ROHS COMPLIANT, LQFP-100
文件页数： 282/328页
文件大小： 3111K
代理商： ST10F252M-4T3
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ST10F252M
Internal Flash memory
57/328
8.4.2
Flash control register 0 high (FCR0H)
The Flash Control Register 0 High (FCR0H) together with the Flash Control Register 0 Low
(FCR0L) is used to enable and to monitor all the write operations on the IFlash. The user
has no access in write mode to the Test-Flash (B0TF). Moreover, the Test-Flash block is
seen by the user in Bootstrap mode only.
Table 25.
Flash control register 0 low
Bit
Name
Function
15:5 Reserved
These bits are left at their reset value (0).
4LOCK
Flash Registers Access Locked
When this bit is set, it means that the access to the Flash Control
Registers FCR0H/-FCR1H/L, FDR0H/L-FDR1H/L, FARH/L and FER is
locked by the FPEC: any read access to the registers will output invalid
data (software trap 009Bh) and any write access will be ineffective.
LOCK bit is automatically set when the Flash bit WMS is set.
This is the only bit the user can always access to detect the status of
the Flash: once it is found low, the rest of FCR0L and all the other
Flash registers are accessible by the user as well.
Note that FER content can be read when LOCK is low, but its content is
updated only when the BSY0 bit is reset.
3.2
Reserved
These bits are left at their reset value (0).
1
BSY
Bank 0 Busy (IFlash)
This bit indicates that a write operation is running on Bank 0 (IFlash). It
is automatically set when bit WMS is set. Setting Protection operation
sets bit BSY0 (since protection registers are in this Block). When this
bit is set, every read access to Bank 0 will output invalid data (software
trap 009Bh), while every write access to the Bank will be ignored. At
the end of the write operation or during a Program or Erase Suspend
this bit is automatically reset and the Bank returns to read mode. After
a Program or Erase Resume this bit is automatically set again.
0
Reserved
This bit is left at its reset value (0).
FCR0H (0x08 0002)
FCR
Reset value: 0000h
15
14
13
12
11
10
9
87654
3210
WMS
SUSP
WPG DWPG
SER
Reserved
SPR
Reserved
RW
-
RW
-
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PDF描述
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