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参数资料
| 型号： | ST10F252M-4T3 |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, FLASH, 40 MHz, RISC MICROCONTROLLER, PQFP100 |
| 封装： | 14 X 14 MM, 1.40 MM HEIGHT, 0.50 MM PITCH, ROHS COMPLIANT, LQFP-100 |
| 文件页数： | 62/328页 |
| 文件大小： | 3111K |
| 代理商： | ST10F252M-4T3 |
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CAN modules
ST10F252M
154/328
As soon the CAN bus is idle, the IF1 registers are loaded into the shift register of the CAN
core and the transmission is started. When the transmission has completed, the Busy bit is
reset and the locked IF1 registers are released.
A pending transmission can be aborted at any time by resetting the Busy bit in the IF1
command request register while the IF1 registers are locked. If the CPU has reset the Busy
bit, a possible retransmission in case of lost arbitration or in case of an error is disabled.
The IF2 registers are used as the receive buffer. After the reception of a message the
contents of the shift register is stored into the IF2 registers, without any acceptance filtering.
Additionally, the actual contents of the shift register can be monitored during the message
transfer. Each time a read message object is initiated by writing the Busy bit of the IF2
command request register to ‘1’, the contents of the shift register are stored into the IF2
registers.
In basic mode the evaluation of all message object related control and status bits and of the
control bits of the IFx command mask registers is turned off. The message number of the
command request registers is not evaluated. The NewDat and MsgLst bits of the IF2
message control register retain their function, DLC3-0 shows the received DLC, the other
control bits are read as ‘0’.
In basic mode the ready output CAN_WAIT_B is disabled (always ‘1’).
18.7.9
Software control of pin CAN_TX
Four output functions are available for the CAN transmit pin CAN_TX. Additionally to its
default function – the serial data output, it can drive the CAN sample point signal to monitor
CAN_Core’s bit timing and it can drive constant dominant or recessive values. The last two
functions, combined with the readable CAN receive pin CAN_RX, can be used to check the
CAN bus physical layer.
The output mode of pin CAN_TX is selected by programming the Test Register bits Tx1 and
Tx0 as described in Section 18.8.2.
The three test functions for pin CAN_TX interfere with all CAN protocol functions. CAN_TX
must be left in its default function when CAN message transfer or any of the test modes loop
back mode, silent mode, or basic mode are selected.
18.8
Programmer’s model
The C-CAN module allocates an address space of 256 bytes. The registers are organized
as 16-bit registers, with the high byte at the odd address and the low byte at the even
address.
The two sets of interface registers (IF1 and IF2) control the CPU access to the message
RAM. They buffer the data to be transferred to and from the RAM, avoiding conflicts
between CPU accesses and message reception/transmission.
Table 91.
C-CAN register summary
Address
Name
Reset Value
Note
CAN Base + 0x00
CAN Control Register
0x0001
CAN Base + 0x02
Status Register
0x0000
CAN Base + 0x04
Error Counter
0x0000
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