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参数资料
| 型号： | ST40RA150XH6 |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, 150 MHz, RISC PROCESSOR, PBGA372 |
| 封装： | 27 X 27 MM, BGA-372 |
| 文件页数： | 74/90页 |
| 文件大小： | 672K |
| 代理商： | ST40RA150XH6 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页当前第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页
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ST40RA166
A Interconnect architecture
A.2.1
LMI1 arbiter
0x318
PCI
_CPU_PRI
Defines priority for the CPU in the PCI arbiter, see
page 79
0x320
PCI
_LATENCY_PCI
Defines priority and latency value for PCI initiator in the PCI arbiter, see
page 79
0x328
PCI
_LATENCY_EMPI
Defines priority and latency value for EMPI initiator in the PCI arbiter, see
page 79
0x330
PCI
_LATENCY_GPDMA
Defines priority and latency value for GPDMA initiator in the PCI arbiter, see
page 80
0x410
LATENCY
_PER_ENABLE
Enables or disables initiators latency counters, see
page 80
0x418
PER
_CPU_PRI
Defines priority for the CPU in the peripheral arbiter, see
page 80
0x420
PER
_LATENCY_PCI
Defines priority and latency value for PCI initiator in the peripheral arbiter, see
page 80
0x428
PER
_LATENCY_EMPI
Defines priority and latency value for EMPI initiator in the peripheral arbiter, see
page 81
0x430
PER
_LATENCY_GPDMA
Defines priority and latency value for GPDMA initiator in the peripheral arbiter,
see
page 81
LATENCY_LMI1_ENABLE
LMI1 arbiter: enable latency counters
0x010
0
Reserved
Reset: Always 0
1
ENABLE
_1
Enable latency check for node 2
Reset: 0
RW
[31:2]
Reserved
Reset: Always 0
LMI1_CPU_PRI
LMI1 arbiter: CPU priority
0x018
[3:0]
CPU
_PRIORITY
Defines priority for CPU
Reset: 0x1
RW
[31:4]
Reserved
LATENCY_LMI1_VALUE
LMI1 arbiter: node 2 intitiator priority and latency
0x020
[3:0]
NODE
2_PRIORITY
Defines priority for node 2 initiators
Reset: 0x0
RW
[15:4]
Reserved
[23:16]
NODE
2_LATENCY
Defines maximum accepted latency for node 2 initiators
Reset: 0x00
RW
[31:24]
Reserved
Address
offset
Name
Function
Table 36: Interconnect register summary
相关PDF资料 |
PDF描述 |
|---|---|
| ST40RA200XH6E | 32-BIT, 200 MHz, RISC PROCESSOR, PBGA372 |
| ST52510F3M6 | MICROCONTROLLER, PDSO20 |
| ST52E430B/D | 8-BIT, UVPROM, 20 MHz, MICROCONTROLLER, CDIP32 |
| ST52F510F1M6 | 8-BIT, FLASH, 24 MHz, MICROCONTROLLER, PDSO20 |
| ST52F510G0B6 | 8-BIT, FLASH, 24 MHz, MICROCONTROLLER, PDIP28 |
相关代理商/技术参数 |
参数描述 |
|---|---|
| ST40RA150XHA | 制造商:STMICROELECTRONICS 制造商全称:STMicroelectronics 功能描述:32-bit Embedded SuperH Device |
| ST40RA166 | 制造商:STMICROELECTRONICS 制造商全称:STMicroelectronics 功能描述:32-BIT EMBEDDED SUPERH MICROPROCESSOR |
| ST40RA166XH1 | 制造商:STMicroelectronics 功能描述: |
| ST40RA166XH6 | 制造商:STMicroelectronics 功能描述:32-BIT SUPERH CPU - Trays |
| ST40RA166XH6/TR | 制造商:STMicroelectronics 功能描述: |
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