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参数资料
| 型号： | ST5x86 |
| 厂商： | 意法半导体 |
| 英文描述： | 100 and 120 MHz 3.45 Volt 5x86 CPU(微处理器) |
| 中文描述： | 100和120兆赫3.45伏特5x86的CPU（微处理器） |
| 文件页数： | 7/39页 |
| 文件大小： | 326K |
| 代理商： | ST5X86 |
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ST5x86
7/39
Figure 1.3. Configuration Control Register 1 (CCR1)
Table 1.3. CCR1 Bit Definitions
BIT
POSITION
NAME
DESCRIPTION
1*
USE_SMI
Enable SMM Pins
If = 1: SMI# input/output pin and SMADS# output pin are enabled.
If = 0: SMI# input pin ignored and SMADS# output pin floats.
2*
SMAC
System Management Memory Access
If = 1: Any access to addresses within the SMM memory space cause external bus
cycles to be issued with SMADS# output active. SMI# input is ignored.
If = 0: No effect on access.
3*
MMAC
Main Memory Access
If = 1: All data accesses which occur within an SMI service routine (or when SMAC = 1)
access main memory instead of SMM memory space.
If = 0: No effect on access.
Note:
Bits 0, 4-7 are reserved. Bits1-3 are cleared to 0 at reset.
*Note:
Access enabled by CCR3, bit 0, SMI-Lock bit.
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