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参数资料
型号： ST72F60E1M1
厂商： STMICROELECTRONICS
元件分类： 微控制器/微处理器
英文描述： 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PDSO24
封装： 0.300 INCH, LEAD FREE, PLASTIC, SOP-24
文件页数： 126/139页
文件大小： 1993K
代理商： ST72F60E1M1
ST7260xx
Serial communications interface (SCI)
87/139
13.3.5
Baud rate register (SCIBRR)
SCIBRR
Reset value:
0000 0000 (00h)
76
543
21
0
SCP[1:0]
SCT[2:0]
SCR[2:0]
R/W
Table 41.
SCIBRR register description
Bit
Name
Function
7:6
SCP[1:0]
First SCI Prescaler
These 2 prescaling bits allow several standard clock division ranges.
00: PR prescaling factor = 1
01: PR prescaling factor = 3
10: PR prescaling factor = 4
11: PR prescaling factor = 13
5:3
SCT[2:0]
SCI Transmitter rate divisor
These 3 bits, in conjunction with the SCP1 and SCP0 bits, define the total division
applied to the bus clock to yield the transmit rate clock in conventional baud rate
generator mode.
000: TR dividing factor = 1
001: TR dividing factor = 2
010: TR dividing factor = 4
011: TR dividing factor = 8
100: TR dividing factor = 16
101: TR dividing factor = 32
110: TR dividing factor = 64
111: TR dividing factor = 128
2:0 SCR[2:0]
SCI Receiver rate divisor
These 3 bits, in conjunction with the SCP[1:0] bits, define the total division applied
to the bus clock to yield the receive rate clock in conventional baud rate generator
mode.
000: RR dividing factor = 1
001: RR dividing factor = 2
010: RR dividing factor = 4
011: RR dividing factor = 8
100: RR dividing factor = 16
101: RR dividing factor = 32
110: RR dividing factor = 64
111: RR dividing factor = 128
Table 42.
SCI register map and reset values
Address
(Hex.)
Register
Label
76
543
210
20
SCISR
Reset Value
TDRE
1
TC
1
RDRF
0
IDLE
0
OR
0
NF
0
FE
0
PE
0
21
SCIDR
Reset Value
DR7
x
DR6
x
DR5
x
DR4
x
DR3
x
DR2
x
DR1
x
DR0
x
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PDF描述
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