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参数资料
| 型号： | ST72F60E1M1 |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PDSO24 |
| 封装： | 0.300 INCH, LEAD FREE, PLASTIC, SOP-24 |
| 文件页数： | 18/139页 |
| 文件大小： | 1993K |
| 代理商： | ST72F60E1M1 |
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Electrical characteristics
ST7260xx
114/139
16.5
Clock and timing characteristics
Subject to general operating conditions for VDD, fCPU, and TA.
16.5.1
General timings
16.5.2
Control timing characteristics
Figure 46.
Typ. IDD in RUN at 4 and 8
MHz fCPU
Figure 47.
Typ. IDD in WAIT at 4 and 8
MHz fCPU
Idd Run (mA) at fcpu=4 and 8MHz
0
2
4
6
8
10
12
4
4.2
4.4
4.6
4.8
5
5.2
5.4
Vdd (V)
Idd
R
un
(
m
A
)
8MHz
4MHz
Idd WFI (mA) at fcpu=4 and 8MHz
0
2
4
6
8
10
4
4.2
4.4
4.6
4.8
5
5.2
5.4
Vdd (V)
Id
d
W
F
I
(m
A
)
8MHz
4MHz
Table 61.
CPU timings
Symbol
Parameter
Conditions
Min
Typ (1)
1.
Data based on typical application software.
Max
Unit
tc(INST) Instruction cycle time
fCPU=8 MHz
23
12
t
CPU
250
375
1500
ns
tv(IT)
Interrupt reaction time (2)
tv(IT) = Δtc(INST) + 10 tCPU
2.
Time measured between interrupt event and interrupt vector fetch.
Δt
c(INST) is the number of tCPU cycles
needed to finish the current instruction execution.
fCPU=8 MHz
10
22
t
CPU
1.25
2.75
μs
Table 62.
Control timings
Symbol
Parameter
Conditions
Value
Unit
Min
Typ
Max
fOSC
Oscillator frequency
24
MHz
fCPU
Operating frequency
8
MHz
tRL
External RESET
input pulse width
2520
ns
tPORL
Internal power reset duration
4096
t
CPU
tDOGL
Watchdog or low voltage reset
output pulse width
200
300
ns
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PDF描述 |
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参数描述 |
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