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参数资料
| 型号： | ST72T141K2B1XXX |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, OTPROM, 8 MHz, MICROCONTROLLER, PDIP32 |
| 封装： | 0.400 INCH, SHRINK, PLASTIC, DIP-32 |
| 文件页数： | 98/132页 |
| 文件大小： | 823K |
| 代理商： | ST72T141K2B1XXX |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页当前第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页
ST72141K
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MOTOR CONTROLLER (Cont’d)
INTERRUPT MASK REGISTER (MIMR)
Read/Write (except bits 7:6)
Reset Value: 0000 0000 (00h)
Bit 7 = HST:
Hysteresis Comparator Value.
This read only bit contains the hysteresis compa-
rator output.
0: Demagnetisation/BEMF comparator is under
VREF
1: Demagnetisation/BEMF comparator is above
VREF
Bit 6 = CL:
Current Loop Comparator Value.
This read only bit contains the current loop compa-
rator output value.
0: Current detect voltage is under VCREF
1: Current detect voltage is above VCREF
Bit 5 = RIM:
Ratio update Interrupt Mask bit.
0: Ratio update interrupts (R+ and R-) disabled
1: Ratio update interrupts (R+ and R-) enabled
Bit 4 = OIM:
Multiplier Overflow Interrupt Mask bit.
0: Multiplier Overflow interrupt disabled
1: Multiplier Overflow interrupt enabled
Bit 3 = EIM:
Emergency stop Interrupt Mask bit.
0: Emergency stop interrupt disabled
1: Emergency stop interrupt enabled
Bit 2 = ZIM:
Back EMF Zero-crossing Interrupt
Mask bit.
0: BEMF Zero-crossing Interrupt disabled
1: BEMF Zero-crossing Interrupt enabled
Bit 1 = DIM:
End of Demagnetization Interrupt
Mask bit.
0: End of Demagnetization interrupt disabled
1: End of Demagnetization interrupt enabled if the
HDM or SDM bit in the MCRB register is set
Bit 0 = CIM:
Commutation Interrupt Mask bit
0: Commutation Interrupt disabled
1: Commutation Interrupt enabled
INTERRUPT STATUS REGISTER (MISR)
Read/Write
Reset Value: 0000 0000 (00h)
Bit 7 = Reserved. Forced by hardware to 0.
Bit 6 = RPI:
Ratio Increment interrupt flag.
Autoswitched mode (SWA bit =0):
0: No R+ interrupt pending
1: R+ Interrupt pending
Switched mode (SWA bit =1):
0: No R+ action
1: The hardware will increment the ST[3:0] bits
when the next commutation occurs and shift all
timer registers right.
Bit 5 = RMI:
Ratio Decrement interrupt flag.
Autoswitched mode (SWA bit =0):
0: No R- interrupt pending
1: R- Interrupt pending
Switched mode (SWA bit =1):
0: No R- action
1: The hardware will decrement the ST[3:0] bits
when the next commutation occurs and shift all
timer registers left.
Bit 4 = OI:
Multiplier Overflow interrupt flag.
0: No Multiplier Overflow interrupt pending
1: Multiplier Overflow interrupt pending
Bit 3 = EI:
Emergency stop Interrupt flag.
0: No Emergency stop interrupt pending
1: Emergency stop interrupt pending
Bit 2 = ZI:
BEMF Zero-crossing interrupt flag.
0: No BEMF Zero-crossing Interrupt pending
1: BEMF Zero-crossing Interrupt pending
Bit 1 = DI:
End of Demagnetization interrupt flag.
0: No End of Demagnetization interrupt pending
1: End of Demagnetization interrupt pending
Bit 0 = CI:
Commutation interrupt flag
0: No Commutation Interrupt pending
1: Commutation Interrupt pending
70
HST
CL
RIM
OIM
EIM
ZIM
DIM
CIM
70
0
RPI
RMI
OI
EI
ZI
DI
CI
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PDF描述 |
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