参数资料
型号: TMS320C6747BZKB4
厂商: TEXAS INSTRUMENTS INC
元件分类: 数字信号处理
英文描述: OTHER DSP, PBGA256
封装: PLASTIC, BGA-256
文件页数: 104/219页
文件大小: 1557K
代理商: TMS320C6747BZKB4
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TION
SPRS377D – SEPTEMBER 2008 – REVISED AUGUST 2010
www.ti.com
6.29 Power and Sleep Controller (PSC)
The Power and Sleep Controllers (PSC) are responsible for managing transitions of system power on/off,
clock on/off, resets (device level and module level). It is used primarily to provide granular power control
for on chip modules (peripherals and CPU). A PSC module consists of a Global PSC (GPSC) and a set of
Local PSCs (LPSCs). The GPSC contains memory mapped registers, PSC interrupts, a state machine for
each peripheral/module it controls. An LPSC is associated with every module that is controlled by the PSC
and provides clock and reset control.
The PSC includes the following features:
Provides a software interface to:
Control module clock enable/disable
Control module reset
Control CPU local reset
Supports ICEpick TAP Router power, clock and reset features. For details on ICEpick features see
Table 6-101. Power and Sleep Controller (PSC) Registers
PSC0
PSC1
ACRONYM
REGISTER DESCRIPTION
BYTE ADDRESS
0x01C1 0000
0x01E2 7000
REVID
Peripheral Revision and Class Information Register
0x01C1 0018
0x01E2 7018
INTEVAL
Interrupt Evaluation Register
0x01C1 0040
0x01E2 7040
MERRPR0
Module Error Pending Register 0 (module 0-15) (PSC0)
Module Error Pending Register 0 (module 0-31) (PSC1)
0x01C1 0050
0x01E2 7050
MERRCR0
Module Error Clear Register 0 (module 0-15) (PSC0)
Module Error Clear Register 0 (module 0-31) (PSC1)
0x01C1 0060
0x01E2 7060
PERRPR
Power Error Pending Register
0x01C1 0068
0x01E2 7068
PERRCR
Power Error Clear Register
0x01C1 0120
0x01E2 7120
PTCMD
Power Domain Transition Command Register
0x01C1 0128
0x01E2 7128
PTSTAT
Power Domain Transition Status Register
0x01C1 0200
0x01E2 7200
PDSTAT0
Power Domain 0 Status Register
0x01C1 0204
0x01E2 7204
PDSTAT1
Power Domain 1 Status Register
0x01C1 0300
0x01E2 7300
PDCTL0
Power Domain 0 Control Register
0x01C1 0304
0x01E2 7304
PDCTL1
Power Domain 1 Control Register
0x01C1 0400
0x01E2 7400
PDCFG0
Power Domain 0 Configuration Register
0x01C1 0404
0x01E2 7404
PDCFG1
Power Domain 1 Configuration Register
0x01C1 0800 -
0x01E2 7800 -
MDSTAT0-MDSTAT15
Module Status n Register (modules 0-15) (PSC0)
0x01C1 083C
0x01E2 787C
MDSTAT0-MDSTAT31
Module Status n Register (modules 0-31) (PSC1)
0x01C1 0A00 -
0x01E2 7A00 -
MDCTL0-MDCTL15
Module Control n Register (modules 0-15) (PSC0)
0x01C1 0A3C
0x01E2 7A7C
MDCTL0-MDCTL31
Module Control n Register (modules 0-31) (PSC1)
6.29.1 Power Domain and Module Topology
The device includes two PSC modules.
Each PSC module controls clock states for several of the on chip modules, controllers and interconnect
components. Table 6-102 and Table 6-103 lists the set of peripherals/modules that are controlled by the
PSC, the power domain they are associated with, the LPSC assignment and the default (power-on reset)
module states. The module states and terminology are defined in Section 6.29.1.1.
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Peripheral Information and Electrical Specifications
Copyright 2008–2010, Texas Instruments Incorporated
Product Folder Link(s): TMS320C6745/6747
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