参数资料
型号: TMS320C6747BZKB4
厂商: TEXAS INSTRUMENTS INC
元件分类: 数字信号处理
英文描述: OTHER DSP, PBGA256
封装: PLASTIC, BGA-256
文件页数: 98/219页
文件大小: 1557K
代理商: TMS320C6747BZKB4
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SPRS377D – SEPTEMBER 2008 – REVISED AUGUST 2010
Table 6-100. Switching Characteristics for Host-Port Interface Cycles(1) (2) (3)
No.
PARAMETER
MIN
MAX
UNIT
For HPI Write, HRDY can go high (not ready)
for these HPI Write conditions; otherwise,
HRDY stays low (ready):
Case 1: Back-to-back HPIA writes (can be
either first or second half-word)
Case 2: HPIA write following a PREFETCH
command (can be either first or second
half-word)
Case 3: HPID write when FIFO is full or
flushing (can be either first or second
half-word)
Case 4: HPIA write and Write FIFO not empty
For HPI Read, HRDY can go high (not ready)
for these HPI Read conditions:
Delay time,
5
td(HSTBL-HRDYV)
12
ns
Case 1: HPID read (with auto-increment) and
HSTROBE low to HRDY valid
data not in Read FIFO (can only happen to
first half-word of HPID access)
Case 2: First half-word access of HPID Read
without auto-increment
For HPI Read, HRDY stays low (ready) for
these HPI Read conditions:
Case 1: HPID read with auto-increment and
data is already in Read FIFO (applies to either
half-word of HPID access)
Case 2: HPID read without auto-increment
and data is already in Read FIFO (always
applies to second half-word of HPID access)
Case 3: HPIC or HPIA read (applies to either
half-word access)
5a
td(HASL-HRDYV)
Delay time, HAS low to HRDY valid
12
6
ten(HSTBL-HDLZ)
Enable time, HD driven from HSTROBE low
2
ns
7
td(HRDYL-HDV)
Delay time, HRDY low to HD valid
0
ns
8
toh(HSTBH-HDV)
Output hold time, HD valid after HSTROBE high
1.5
ns
14
tdis(HSTBH-HDHZ)
Disable time, HD high-impedance from HSTROBE high
12
ns
For HPI Read. Applies to conditions where
data is already residing in HPID/FIFO:
Case 1: HPIC or HPIA read
Delay time,
Case 2: First half-word of HPID read with
15
td(HSTBL-HDV)
15
ns
HSTROBE low to HD valid
auto-increment and data is already in Read
FIFO
Case 3: Second half-word of HPID read with
or without auto-increment
For HPI Write, HRDY can go high (not ready)
for these HPI Write conditions; otherwise,
HRDY stays low (ready):
Case 1: HPID write when Write FIFO is full
Delay time,
18
td(HSTBH-HRDYV)
(can happen to either half-word)
12
ns
HSTROBE high to HRDY valid
Case 2: HPIA write (can happen to either
half-word)
Case 3: HPID write without auto-increment
(only happens to second half-word)
(1)
M=SYSCLK2 period (CPU clock frequency)/2 in ns.
(2)
HSTROBE refers to the following logical operation on HCS, HDS1, and HDS2: [NOT(HDS1 XOR HDS2)] OR HCS.
(3)
By design, whenever HCS is driven inactive (high), HPI will drive HRDY active (low).
Copyright 2008–2010, Texas Instruments Incorporated
Peripheral Information and Electrical Specifications
187
Product Folder Link(s): TMS320C6745/6747
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