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参数资料
| 型号： | TSC87C51-L16IEB |
| 厂商： | ATMEL CORP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, OTPROM, 16 MHz, MICROCONTROLLER, PQFP44 |
| 封装： | 1.40 MM HEIGHT, VQFP-44 |
| 文件页数： | 128/176页 |
| 文件大小： | 2962K |
| 代理商： | TSC87C51-L16IEB |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页当前第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页
55
2535J–AVR–08/10
ATtiny13
Table 10-4 and Table 10-5 relate the alternate functions of Port B to the overriding signals
shown in Figure 10-5 on page 53.
Note:
1. 1 when the fuse is “0” (Programmed).
Table 10-3.
Port B Pins Alternate Functions
Port Pin
Alternate Function
PB5
RESET: Reset Pin
dW:
debugWIRE I/O
ADC0: ADC Input Channel 0
PCINT5: Pin Change Interrupt, Source 5
PB4
ADC2: ADC Input Channel 2
PCINT4: Pin Change Interrupt 0, Source 4
PB3
CLKI:
External Clock Input
ADC3: ADC Input Channel 3
PCINT3: Pin Change Interrupt 0, Source 3
PB2
SCK:
Serial Clock Input
ADC1: ADC Input Channel 1
T0:
Timer/Counter0 Clock Source.
PCINT2: Pin Change Interrupt 0, Source 2
PB1
MISO:
SPI Master Data Input / Slave Data Output
AIN1:
Analog Comparator, Negative Input
OC0B: Timer/Counter0 Compare Match B Output
INT0:
External Interrupt 0 Input
PCINT1:Pin Change Interrupt 0, Source 1
PB0
MOSI:: SPI Master Data Output / Slave Data Input
AIN0:
Analog Comparator, Positive Input
OC0A: Timer/Counter0 Compare Match A output
PCINT0: Pin Change Interrupt 0, Source 0
Table 10-4.
Overriding Signals for Alternate Functions in PB5:PB3
Signal
PB5/RESET/ADC0/PCINT5
PB4/ADC2/PCINT4
PB3/ADC3/CLKI/PCINT3
PUOE
00
PUOV
100
DDOE
00
DDOV
debugWire Transmit
0
PVOE
0
PVOV
0
PTOE
000
DIEOE
RSTDISBL(1) + (PCINT5
PCIE + ADC0D)
PCINT4 PCIE + ADC2D
PCINT3 PCIE + ADC3D
DIEOV
ADC0D
ADC2D
ADC3D
DI
PCINT5 Input
PCINT4 Input
PCINT3 Input
AIO
RESET Input, ADC0 Input
ADC2 Input
ADC3 Input
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PDF描述 |
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