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参数资料
| 型号： | WBLXT9785HCC2V |
| 厂商： | CORTINA SYSTEMS INC |
| 元件分类： | 网络接口 |
| 英文描述： | DATACOM, INTERFACE CIRCUIT, PQFP208 |
| 封装： | ROHS COMPLIANT, PLASTIC, HQFP-208 |
| 文件页数： | 19/234页 |
| 文件大小： | 3982K |
| 代理商： | WBLXT9785HCC2V |
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LXT9785 and LXT9785E Advanced 8-Port 10/100 Mbps PHY Transceivers
Datasheet
115
Document Number: 249241
Revision Number: 010
Revision Date: 30-May-2006
4.0
Functional Description
4.1
Introduction
The Intel
LXT9785/LXT9785E is an 8-port Fast Ethernet 10/100 PHY transceiver that supports
10 Mbps and 100 Mbps networks, complying with all applicable requirements of IEEE 802.3
standards. The device incorporates a Serial Media Independent Interface (SMII), Source
Synchronous-Serial Media Independent Interface (SS-SMII), and a Reduced Serial Independent
Interface (RMII) to enable each individual network port to interface with multiple 10/100 MACs.
Each port directly drives either a 100BASE-TX line or a 10BASE-T line. The LXT9785/9785E
also supports 100BASE-FX operation via an LVPECL interface. The device has a 241-ball BGA, a
208-pin QFP, or a 196-ball BGA package.
The 196-ball BGA package (BGA15) is a reduced feature-set product designated as the
LXT9785MBC. The BGA15 package does not support the following features:
RMII
Fiber
Sectionalization
Hardware control pins:
— PAUSE
—MDIX
— MDDIS
—PWRDWN
— Lower three PHY address (out of five PHY address bits)
Extended temperature
Note:
Unless otherwise noted, all information in this document applies to the LXT9785 and LXT9785E.
4.1.1
OSP Architecture
The Intel LXT9785/LXT9785E incorporates high-efficiency Optimal Signal Processing design
techniques, combining the best properties of digital and analog signal processing to produce a truly
optimal device.
The receiver utilizes decision feedback equalization to increase noise and cross-talk immunity by
as much as 3 dB over an ideal all-analog equalizer. Using OSP mixed-signal processing techniques
in the receive equalizer avoids the quantization noise and calculation truncation errors found in
traditional DSP-based receivers (typically complex DSP engines with A/D converters). The result
is improved receiver noise and cross-talk performance.
The OSP architecture also requires substantially less computational logic than traditional DSP-
based designs. The result is lower power consumption and reduced logic switching noise generated
by DSP engines clocked at speeds up to 125 MHz. The logic switching noise can be a considerable
source of EMI when generated from the device’s power supplies.
相关PDF资料 |
PDF描述 |
|---|---|
| WBLXT9785HCD0 | DATACOM, INTERFACE CIRCUIT, PQFP208 |
| WBLXT9785HEC2V | DATACOM, INTERFACE CIRCUIT, PQFP208 |
| WBLXT9785HED0 | DATACOM, INTERFACE CIRCUIT, PQFP208 |
| WE128K16-150CM | 128K X 16 EEPROM 5V MODULE, 150 ns, CDMA40 |
| WE128K16-150CQA | 128K X 16 EEPROM 5V MODULE, 150 ns, CDMA40 |
相关代理商/技术参数 |
参数描述 |
|---|---|
| WBLXT9785HE.D0-865114 | 制造商:Cortina Systems Inc 功能描述:PHY 8-CH 10Mbps/100Mbps 208-Pin PQFP |
| WBM-DATA | 制造商:Thomas & Betts 功能描述: |
| WBM-DISHWASH | 制造商:Thomas & Betts 功能描述: |
| WBM-DISPOSAL | 制造商:Thomas & Betts 功能描述: |
| WBM-DUPLEX | 制造商:Thomas & Betts 功能描述: |
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